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參數(shù)資料
| 型號： | UPD17073GB |
| 廠商： | NEC Corp. |
| 英文描述： | 4-BIT SINGLE-CHIP MICROCONTROLLER WITH HARDWARE FOR DIGITAL TUNING SYSTEM |
| 中文描述： | 4位單芯片的數(shù)字調(diào)諧系統(tǒng)硬件單片機(jī) |
| 文件頁數(shù)： | 162/226頁 |
| 文件大?。?/td> | 1250K |
| 代理商： | UPD17073GB |
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μ
PD17072,17073
162
18.4 Common Signal Output and Segment Signal Output Timing Control Blocks
Figure 18-5 shows the common signal output and segment signal output timing control blocks.
The common signal output timing control block controls the common signal output timing of the COM0 through
COM3 pins.
The segment signal output timing control block controls the segment signal output timing of the LCD0 through
LCD14 pins.
The common and segment signals are output when the LCDEN flag of the LCD driver display start register is set
to “1”.
When this flag is reset to “0”, all the LCD display dots can be extinguished (refer to
Figure 18-6
).
When LCD display is not carried out, the COM0 through COM3 and LCD0 through LCD14 pins output low level.
Figure 18-5. Configuration of Common Signal Output and Segment Signal Output Timing Control Blocks
Segment signal
Common signal
LCD0
|
LCD14
COM0
|
COM3
Segment signal
output timing control
block
Basic clock for
timing control
Common signal output
timing control block
LCDEN flag
LCDD0
|
LCDD14
b
0
b
1
b
2
b
3
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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