參數(shù)資料
型號(hào)： UPD17707
廠商： NEC Corp.
英文描述： 4-BIT SINGLE-CHIP MICROCONTROLLERS WITH DEDICATED HARDWARE FOR DIGITAL TUNING SYSTEM
中文描述： 4位的單芯片專用數(shù)字調(diào)諧系統(tǒng)硬件微控制器
文件頁(yè)數(shù)： 301/356頁(yè)
文件大?。?/td> 1525K
代理商： UPD17707
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301
μ
PD17704, 17705, 17707, 17708, 17709
20.4 Device Operation in Halt and Clock Stop Status
Table 20-1 shows the operations of the CPU and peripheral hardware units in the halt and clock stop status.
In the halt status, all the peripheral hardware units continue the normal operation until instruction execution is
stopped.
In the clock stop status, all the peripheral hardware units stop operation.
The control registers that control the operations of the peripheral hardware units operate normally (not initialized)
in the halt status, but are initialized to specified values when the clock stop instruction is executed.
In other words, all peripheral hardware continues the operation specified by the control register in the halt status,
and the operation is determined by the initialized value of the control register in the clock stop status.
For the values of the control registers in the clock stop status, refer to
8. REGISTER FILE (RF)
.
Table 20-1. Device Operation in Halt and Clock Stop Status
Peripheral Hardware
Status
Halt
Clock stop
Program counter
Stops at address of HALT instruction
Stops at address of STOP instruction
System register
Retained
Retained
Peripheral register
Retained
Partly initialized
Note 1
Control register
Retained
Partly initialized
Note 1
Timer
Normal operation
Operation stops
PLL frequency synthesizer
Normal operation
Note 2
Operation stops
A/D converter
Normal operation
Operation stops
D/A converter
Normal operation
Stops operation and used as general-
purpose output port
Serial interface
Stops operation when internal clock (master)
is selected and continues operation when
external clock (slave) is selected
Stops operation and used as general-
purpose I/O port
Frequency counter
Normal operation
Stops operation and used as general-
purpose input port
BEEP output
Normal operation
Stops operation and used as general-
purpose I/O port
General-purpose I/O port
Normal operation
Retained
General-purpose input port
Normal operation
Input port
General-purpose output port
Normal operation
Retains output latch
Notes 1.
For the value to which these registers are initialized, refer to
5. SYSTEM REGISTER (SYSREG)
and
8. REGISTER FILE (RF)
.
2.
The PLL frequency synthesizer is automatically disabled by the low level input to the CE pin.
20.5 Cautions on Processing of Each Pin in Halt and Clock Stop Status
The halt status is used to reduce the current consumption when, say, only the watch is used.
The clock stop function is used to reduce the current consumption of the device to only use the data memory.
Therefore, the current consumption must be reduced as much as possible in the halt status or clock stop status.
At this time, the current consumption significantly varies depending on the status of each pin, and the points shown
in Table 20-2 must be noted.
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UPD17707GC-XXX-3B9 制造商:未知廠家 制造商全稱:未知廠家 功能描述:4-Bit Microcontroller
UPD17708 制造商:NEC 制造商全稱:NEC 功能描述:4-BIT SINGLE-CHIP MICROCONTROLLERS WITH DEDICATED HARDWARE FOR DIGITAL TUNING SYSTEM
UPD17708A 制造商:未知廠家 制造商全稱:未知廠家 功能描述:UPD17704A.17705A.17707A.17708A.17709A Data Sheet | Data Sheet[10/2001]
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