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參數(shù)資料
| 型號(hào)： | UPD44324092F5-E40-EQ2 |
| 廠商： | NEC Corp. |
| 元件分類： | DRAM |
| 英文描述： | 36M-BIT DDRII SRAM 2-WORD BURST OPERATION |
| 中文描述： | 36M條位SRAM的2條DDRII字爆發(fā)運(yùn)作 |
| 文件頁(yè)數(shù)： | 9/32頁(yè) |
| 文件大小： | 349K |
| 代理商： | UPD44324092F5-E40-EQ2 |
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9
Preliminary Data Sheet
M16780EJ2V0DS
μ
PD44324082, 44324092, 44324182, 44324362
Power-on Sequence
The following two timing charts show the recommended power-on sequence, i.e., when starting the clock after
V
DD
/V
DD
Q stable and when starting the clock before V
DD
/V
DD
Q stable.
1. Clock starts after V
DD
/V
DD
Q stable
V
DD
/V
DD
Q
V
DD
/V
DD
Q Stable (<
±
0.1 V DC per 50 ns)
Clock Start
1,024 cycles or more
Stable Clock
Start
Normal Operation
Clock
2. Clock starts before V
DD
/V
DD
Q stable
V
DD
/V
DD
Q
V
DD
/V
DD
Q Stable (<
±
0.1 V DC per 50 ns)
Clock Start
1,024 cycles or more
Stable Clock
30 ns (MIN.)
DLL Reset or DLL Off
Start
Normal Operation
Clock
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD44324182F5-E40-EQ2 | 36M-BIT DDRII SRAM 2-WORD BURST OPERATION |
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參數(shù)描述 |
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