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參數(shù)資料
| 型號： | UPD4481181 |
| 廠商： | NEC Corp. |
| 英文描述： | 8M-BIT ZEROSB SRAM FLOW THROUGH OPERATION |
| 中文描述： | 800萬位ZEROSB SRAM的流動經(jīng)手術(shù) |
| 文件頁數(shù)： | 12/28頁 |
| 文件大小： | 326K |
| 代理商： | UPD4481181 |
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12
Data Sheet M15561EJ3V0DS
μ
PD4481161, 4481181, 4481321, 4481361
Partial Truth Table for Write Enables
μ
PD4481161,
μ
PD4481181]
Operation
/WE
/BW1
/BW2
Read Cycle
H
×
×
Write Cycle / Byte 1 (I/O [1:8], I/OP1)
L
L
H
Write Cycle / Byte 2 (I/O [9:16], I/OP2)
L
H
L
Write Cycle / All Bytes
L
L
L
Write Abort / NOP
L
H
H
Remark
×
: don’t care
[
μ
PD4481321,
μ
PD4481361]
Operation
/WE
/BW1
/BW2
/BW3
/BW4
Read Cycle
H
×
×
×
×
Write Cycle / Byte 1 (I/O [1:8], I/OP1)
L
L
H
H
H
Write Cycle / Byte 2 (I/O [9:16], I/OP2)
L
H
L
H
H
Write Cycle / Byte 3 (I/O [17:24], I/OP3)
L
H
H
L
H
Write Cycle / Byte 4 (I/O [25:32], I/OP4)
L
H
H
H
L
Write Cycle / All Bytes
L
L
L
L
L
Write Abort / NOP
L
H
H
H
H
Remark
×
: don’t care
ZZ (Sleep) Truth Table
ZZ
Chip Status
≤
0.2 V
Active
Open
Active
≥
V
DD
0.2 V
Sleep
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD4481321 | 8M-BIT ZEROSB SRAM FLOW THROUGH OPERATION |
| UPD4481161GF-A85 | 8M-BIT ZEROSB SRAM FLOW THROUGH OPERATION |
| UPD4481181GF-A85 | 8M-BIT ZEROSB SRAM FLOW THROUGH OPERATION |
| UPD4481321GF-A85 | 8M-BIT ZEROSB SRAM FLOW THROUGH OPERATION |
| UPD4481361GF-A85 | 8M-BIT ZEROSB SRAM FLOW THROUGH OPERATION |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD45128163G5 | 制造商:Renesas Electronics Corporation 功能描述:128 MBIT SDRAM |
| UPD45128163G5-A75-9JF | 制造商:Elpida Memory Inc 功能描述:8M X 16 SYNCHRONOUS DRAM, 5.4 ns, PDSO54 |
| UPD45128841G5-A75-9JF | 制造商:NEC Electronics Corporation 功能描述:SDRAM, 16M x 8, 54 Pin, Plastic, TSOP |
| UPD4516161AG5A109NF | 制造商:NEC Electronics Corporation 功能描述: |
| UPD4516161AG5-A10-9NF | 制造商:NEC Electronics Corporation 功能描述:SDRAM, 1M x 16, 50 Pin, Plastic, TSOP |
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