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參數(shù)資料
| 型號： | UPD4481362GF-A50 |
| 廠商： | NEC Corp. |
| 英文描述： | 8M-BIT ZEROSB SRAM PIPELINED OPERATION |
| 中文描述： | 800萬位ZEROSB SRAM的流水線操作 |
| 文件頁數(shù)： | 10/28頁 |
| 文件大小： | 404K |
| 代理商： | UPD4481362GF-A50 |
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10
Data Sheet M15562EJ3V0DS
μ
PD4481162, 4481182, 4481322, 4481362
State Diagram
DESELECT
BEGIN
READ
BURST
READ
BEGIN
WRITE
BURST
WRITE
WRITE
READ
READ
DS
DS
WRITE
READ
BURST
BURST
WRITE
READ
WRITE
READ
BURST
WRITE
BURST
DS
BURST
DS
DS
Command
Operation
DS
Deselect
Read
New Read
Write
New Write
Burst
Burst Read, Burst Write or Continue Deselect
Remarks 1.
States change on the rising edge of the clock.
2.
A Stall or Ignore Clock Edge cycle is not shown in the above diagram. This is because /CKE HIGH only
blocks the clock (CLK) input and does not change the state of the device.
相關PDF資料 |
PDF描述 |
|---|---|
| UPD4482162 | 8M-BIT CMOS SYNCHRONOUS FAST SRAM PIPELINED OPERATION SINGLE CYCLE DESELECT |
| UPD4482182GF-A50Y | 8M-BIT CMOS SYNCHRONOUS FAST SRAM PIPELINED OPERATION SINGLE CYCLE DESELECT |
| UPD4482182GF-C60 | 8M-BIT CMOS SYNCHRONOUS FAST SRAM PIPELINED OPERATION SINGLE CYCLE DESELECT |
| UPD4482182GF-C60Y | 8M-BIT CMOS SYNCHRONOUS FAST SRAM PIPELINED OPERATION SINGLE CYCLE DESELECT |
| UPD4482162GF-A60 | 8M-BIT CMOS SYNCHRONOUS FAST SRAM PIPELINED OPERATION SINGLE CYCLE DESELECT |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| UPD45128163G5 | 制造商:Renesas Electronics Corporation 功能描述:128 MBIT SDRAM |
| UPD45128163G5-A75-9JF | 制造商:Elpida Memory Inc 功能描述:8M X 16 SYNCHRONOUS DRAM, 5.4 ns, PDSO54 |
| UPD45128841G5-A75-9JF | 制造商:NEC Electronics Corporation 功能描述:SDRAM, 16M x 8, 54 Pin, Plastic, TSOP |
| UPD4516161AG5A109NF | 制造商:NEC Electronics Corporation 功能描述: |
| UPD4516161AG5-A10-9NF | 制造商:NEC Electronics Corporation 功能描述:SDRAM, 1M x 16, 50 Pin, Plastic, TSOP |
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