參數(shù)資料
型號： UPD720110AGC-8EA
廠商： NEC Corp.
英文描述： MOS INTEGRATED CIRCUIT
中文描述： 馬鞍山集成電路
文件頁數(shù)： 17/32頁
文件大?。?/td> 405K
代理商： UPD720110AGC-8EA
Data Sheet S15737EJ5V0DS
17
μ
PD720110A
(2/4)
Parameter
Symbol
Conditions
MIN.
MAX.
Unit
Full-speed Electrical Characteristics (Continued)
Receiver jitter (Figure 2-13):
To Next Transition
For Paired Transitions
t
JR1
t
JR2
18.5
9
+
18.5
+
9
ns
ns
Source SE0 interval of EOP (Figure 2-12)
t
FEOPT
160
175
ns
Receiver SE0 interval of EOP (Figure 2-12)
t
FEOPR
82
ns
Width of SE0 interval during differential
transition
t
FST
14
ns
Hub differential data delay (with cable)
t
HDD1
70
ns
Hub differential data delay (without cable)
(Figure 2-9)
t
HDD2
44
ns
Hub differential driver jitter (including cable)
(Figure 2-9):
To next transition
For paired transitions
t
HDJ1
t
HDJ2
3
1
+
3
+
1
ns
ns
Data bit width distortion after SE0 Figure
2-9)
t
FSOP
5
+
5
ns
Hub EOP delay relative to THDD (Figure
2-10)
t
FEOPD
0
15
ns
Hub EOP output width skew (Figure 2-10)
t
FHESK
15
+
15
ns
High-speed Electrical Characteristics
Rise time (10% to 90%)
t
HSR
500
ps
Fall time (90% to 10%)
t
HSF
500
ps
Driver waveform
See Figure 2-7.
High-speed data rate
t
HSDRAT
479.760
480.240
Mbps
Microframe interval
t
HSFRAM
124.9375
125.0625
μ
s
Consecutive microframe interval difference
t
HSRFI
4 high-
speed
Bit
times
Data source jitter
See Figure 2-7.
Receiver jitter tolerance
See Figure 2-5.
Hub data delay (without cable)
t
HSHDD
36 high-
speed
+
4 ns
Bit
times
Hub data jitter
See Figure 2-5, Figure 2-7.
Hub delay variation range
t
HSHDV
5 high-
speed
Bit
times
Hub Event Timings
Time to detect a downstream facing port
connect event (Figure 2-15):
Awake hub
Suspended hub
t
DCNN
2.5
2.5
2000
12000
μ
s
μ
s
Time to detect a disconnect event at a
hub’s downstream facing port (Figure 2-14)
t
DDIS
2.0
2.5
μ
s
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