參數(shù)資料
型號(hào)： UPD72042
廠商： NEC Corp.
英文描述： LSI DEVICES FOR Inter Equipment BusTM (IEBusTM) PROTOCOL CONTROL
中文描述： LSI器件間設(shè)備BusTM（IEBusTM）協(xié)議控制
文件頁(yè)數(shù)： 27/92頁(yè)
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代理商： UPD72042
μ
PD72042
27
Data Sheet S14870EJ1V0DS00
3.3 CONNECTION TO A MICROCOMPUTER
(1) Three-wire serial I/O
(2) Two-wire serial I/O
Notes 1.
When only the
μ
PD72042 is to be controlled from a microcomputer via a serial I/O interface, the CS pin
must be tied low (by connecting it to GND).
2.
When an interrupt is detected by polling (in FLG register read), IRQ may be left open. When high-volume
or high-speed data transfer is required, however, the system described above is recommended to ensure
reliable data transfer.
3.
Required when the microcomputer’s N-ch open-drain output is used. The SIO pin of the
μ
PD72042 is
a CMOS I/O pin.
120
5 V
V
DD
AV
DD
TEST
BUS+
BUS–
XI
XO
GND
SEL
CS
Note 1
C/D
SCK
SI
SO
IRQ
Note 2
RESET
Output port
Output port
SCK
SO
SI
INT
Low
75XL series
78K series
6 MHz
120
5 V
PD72042
μ
Microcomputer
Microcomputer
120
5 V
6 MHz
120
75XL series
78K series
Low
V
DD
AV
DD
TEST
BUS+
BUS–
XI
XO
GND
SEL
CS
Note 1
C/D
SCK
SIO
SO
IRQ
Note 2
RESET
Output port
Output port
SCK
SIO
INT
Note 3
PD72042
μ
5 V
相關(guān)PDF資料
PDF描述
UPD72042GT LSI DEVICES FOR Inter Equipment BusTM (IEBusTM) PROTOCOL CONTROL
uPD72107GC-3B9 LAP-B CONTROLLER(Link Access Procedure Balanced mode)
UPD72107 LAP-B CONTROLLER(Link Access Procedure Balanced mode)
uPD72107CW LAP-B CONTROLLER(Link Access Procedure Balanced mode)
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參數(shù)描述
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