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參數(shù)資料
| 型號： | UPD75P66 |
| 廠商： | NEC Corp. |
| 英文描述： | 4-Bit, Single-Chip, One-Time Programmable (OTP) CMOS Microcomputer With Comparator |
| 中文描述： | 4位，單芯片，一次性可編程（OTP）的CMOS微機(jī)與比較 |
| 文件頁數(shù)： | 8/40頁 |
| 文件大?。?/td> | 320K |
| 代理商： | UPD75P66 |
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8
μ
PD75P048
Pin Name
TI0
PTO0
PCL
BUZ
SCK
SO/SB0
SI/SB1
INT4
INT0
INT1
INT2
KR0 - KR3
KR4 - KR7
MAR
MAI
MAZ
MAT
PPO
AN0 - AN3
AN4 - AN7
AV
REF+
AV
REF–
AV
DD
AV
SS
I/O Circuit
Type
Note
-C
E-B
E-B
E-B
-A
F
-B
F
-C
-C
-C
B
-A
F
-A
F
M-A
M-A
M-A
M-A
E-B
Y-A
Y-A
Z-A
Z-A
–
–
Shared
Pin
P13
P20
P22
P23
P01
P02
P03
P00
P10
P11
P12
P60 - P63
P70 - P73
P100
P101
P102
P103
P21
P110 - P113
–
–
–
–
–
When Reset
Input
Input
Input
Input
Input
Input
Input
Input
Input
Input
Input
Input
High
impedance
High
impedance
High
impedance
High
impedance
Input
–
–
–
–
–
Input/
Output
Input
I/O
I/O
I/O
I/O
I/O
I/O
Input
Input
Input
I/O
I/O
I/O
I/O
I/O
I/O
I/O
Input
Input
Input
–
–
Function
Input for receiving external event pulse signal
for timer/event counter
Timer/event counter output
Clock output
Output for arbitrary frequency output (for
buzzer output or system clock trimming)
Serial clock I/O
Serial data output
Serial bus I/O
Serial data input
Serial bus I/O
Edge detection vectored interrupt input (either
rising edge or falling edge detection)
Edge detection vectored interrupt input
(detection edge selectable)
Edge detection testable input (rising edge
detection)
Parallel falling edge detection testable input
Parallel falling edge detection testable input
In MFT integrat-
ing A/D
converter mode
In MFT timer
mode
For A/D
converter only
B
1.2 NON-PORT PINS (1/2)
Reverse integration signal
output
Integration signal output
Auto-zero signal output
Comparator input
Timer pulse output
8-bit analog input
Reference voltage input
(AV
DD
side)
Reference voltage input
(AV
SS
side)
Positive power supply
GND potential
Note
The circle (
) indicates the Schmitt trigger input.
Remark
MFT: Multi-Function Timer
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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