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參數(shù)資料
| 型號(hào)： | UPD77213F1-xxx-DA2 |
| 廠商： | NEC Corp. |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | 16-BIT FIXED-POINT DIGITAL SIGNAL PROCESSOR |
| 中文描述： | 16位定點(diǎn)數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 14/74頁(yè) |
| 文件大?。?/td> | 467K |
| 代理商： | UPD77213F1-XXX-DA2 |
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Data Sheet U15203EJ3V0DS
14
μ
PD77210, 77213
Clock and system control pins
Pin No.
Pin Name
144-pin LQFP
161-pin FBGA
I/O
Function
Alternate
Pin
CLKIN
20
C6
Input
Clock input
This pin inputs a clock to operate the
μ
PD77210
Family.
CLKOUT
25
B6
Output
Internal system clock output
This pin outputs the internal system clock that is the
clock input from CLKIN and which is multiplied by the
PLL circuit.
PLL0 to
PLL3
14 to 17
A9,B9,C7,B8
Input
PLL multiple setting input
These pins set a clock multiple of the PLL circuit.
PLL3: PLL2: PLL1: PLL0
0000: x10
0001: x12
0010: x14
0011: x16
0100: x18
0101: x20
0110: x22
0111: x24
1000: x26
1001: x28
1010: x30
1011: x32
1100: x40
1101: x48
1110: x56
1111: x64
HALTS
13
C8
Output
HALT mode status output
This pin is asserted active in halt mode and stop
mode.
STOPS
11
A10
Output
Stop mode status output
This pin is asserted active in stop mode.
CSTOP
12
B10
Input
Stop mode clear signal input
Stop mode is cleared when this pin is asserted
active.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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