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參數(shù)資料
| 型號： | UPD78F0394GC-8EA-A |
| 廠商： | Renesas Electronics America |
| 文件頁數(shù)： | 55/682頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 8BIT 48KB FLASH |
| 標準包裝： | 400 |
| 系列： | 78K0/Lx2 |
| 核心處理器： | 78K/0 |
| 芯體尺寸： | 8-位 |
| 速度： | 20MHz |
| 連通性： | 3 線 SIO，I²C，LIN，UART/USART |
| 外圍設備： | LCD，LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 40 |
| 程序存儲器容量： | 48KB（48K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 5.5 V |
| 數(shù)據(jù)轉換器： | A/D 8x10b |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-LQFP |
| 包裝： | 托盤 |
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CHAPTER 6 CLOCK GENERATOR
User’s Manual U17473EJ2V0UD
146
6.6.4 Example of controlling internal low-speed oscillation clock
The internal low-speed oscillation clock cannot be used as the CPU clock.
Only the following peripheral hardware can operate with this clock.
Watchdog timer
8-bit timer H1 (if fRL is selected as the count clock)
In addition, the following operation modes can be selected by the option byte.
Internal low-speed oscillator cannot be stopped
Internal low-speed oscillator can be stopped by software
The internal low-speed oscillator automatically starts oscillation after a reset release, and the watchdog timer is
driven (240 kHz (TYP.)) if the watchdog timer operation has been enabled by the option byte.
(1) Example of setting procedure when stopping the internal low-speed oscillation clock
<1> Setting LSRSTOP to 1 (RCM register)
When LSRSTOP is set to 1, the internal low-speed oscillation clock is stopped.
(2) Example of setting procedure when restarting oscillation of the internal low-speed oscillation clock
<1> Clearing LSRSTOP to 0 (RCM register)
When LSRSTOP is cleared to 0, the internal low-speed oscillation clock is restarted.
Caution
If “Internal low-speed oscillator cannot be stopped” is selected by the option byte, oscillation of
the internal low-speed oscillation clock cannot be controlled.
6.6.5 Clocks supplied to CPU and peripheral hardware
The following table shows the relation among the clocks supplied to the CPU and peripheral hardware, and setting
of registers.
Table 6-4. Clocks Supplied to CPU and Peripheral Hardware, and Register Setting
Supplied Clock
Clock Supplied to CPU
Clock Supplied to Peripheral Hardware
XSEL
CSS
MCM0
EXCLK
Internal high-speed oscillation clock
0
×
X1 clock
1
0
Internal high-speed oscillation clock
External main system clock
1
0
1
X1 clock
1
0
1
0
External main system clock
1
0
1
Internal high-speed oscillation clock
0
1
×
1
0
X1 clock
1
0
1
0
1
Subsystem clock
External main system clock
1
Remarks 1. XSEL:
Bit 2 of the main clock mode register (MCM)
2. CSS:
Bit 4 of the processor clock control register (PCC)
3. MCM0:
Bit 0 of MCM
4. EXCLK: Bit 7 of the clock operation mode select register (OSCCTL)
5.
×:
don’t care
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