- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄11110 > UPD78F1155AGK-GAK-AX (Renesas Electronics America)MCU 16BIT 78K0R/KX3 80-LQFP PDF資料下載
參數(shù)資料
| 型號(hào)： | UPD78F1155AGK-GAK-AX |
| 廠商： | Renesas Electronics America |
| 文件頁(yè)數(shù)： | 735/908頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | MCU 16BIT 78K0R/KX3 80-LQFP |
| 標(biāo)準(zhǔn)包裝： | 300 |
| 系列： | 78K0R/Kx3 |
| 核心處理器： | 78K/0R |
| 芯體尺寸： | 16-位 |
| 速度： | 20MHz |
| 連通性： | 3 線 SIO，I²C，LIN，UART/USART |
| 外圍設(shè)備： | DMA，LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 65 |
| 程序存儲(chǔ)器容量： | 192KB（192K x 8） |
| 程序存儲(chǔ)器類型： | 閃存 |
| RAM 容量： | 10K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b，D/A 2x8b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 80-LQFP |
| 包裝： | 托盤 |
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CHAPTER 28 ELECTRICAL SPECIFICATIONS (STANDARD PRODUCTS)
User’s Manual U17893EJ8V0UD
758
Standard Products
(2) Serial interface: Serial array unit (5/18)
(d) During communication at same potential (simplified I
2C mode)
Conventional-specification products (
μPD78F115x)
(TA =
40 to +85°C, 2.7 V ≤ VDD = EVDD ≤ 5.5 V, VSS = EVSS = AVSS = 0 V)
Parameter
Symbol
Conditions
MIN.
MAX.
Unit
SCLr clock frequency
fSCL
2.7 V
≤ VDD ≤ 5.5 V,
Cb = 100 pF, Rb = 3 k
Ω
400
Note
kHz
Hold time when SCLr = “L”
tLOW
2.7 V
≤ VDD ≤ 5.5 V,
Cb = 100 pF, Rb = 3 k
Ω
995
ns
Hold time when SCLr = “H”
tHIGH
2.7 V
≤ VDD ≤ 5.5 V,
Cb = 100 pF, Rb = 3 k
Ω
995
ns
Data setup time (reception)
tSU:DAT
2.7 V
≤ VDD ≤ 5.5 V,
Cb = 100 pF, Rb = 3 k
Ω
1/fMCK + 120
ns
Data hold time (transmission)
tHD:DAT
2.7 V
≤ VDD ≤ 5.5 V,
Cb = 100 pF, Rb = 3 k
Ω
0
160
ns
Note
The value must also be fMCK/4 or less.
Expanded-specification products (
μPD78F115xA)
(TA =
40 to +85°C, 1.8 V ≤ VDD = EVDD ≤ 5.5 V, VSS = EVSS = AVSS = 0 V)
Parameter
Symbol
Conditions
MIN.
MAX.
Unit
2.7 V
≤ VDD ≤ 5.5 V,
Cb = 100 pF, Rb = 3 k
Ω
400
Note
kHz
SCLr clock frequency
fSCL
1.8 V
≤ VDD < 2.7 V
Cb = 100 pF, Rb = 5 k
Ω
300
Note
kHz
2.7 V
≤ VDD ≤ 5.5 V,
Cb = 100 pF, Rb = 3 k
Ω
995
ns
Hold time when SCLr = “L”
tLOW
1.8 V
≤ VDD < 2.7 V
Cb = 100 pF, Rb = 5 k
Ω
1500
ns
2.7 V
≤ VDD ≤ 5.5 V,
Cb = 100 pF, Rb = 3 k
Ω
995
ns
Hold time when SCLr = “H”
tHIGH
1.8 V
≤ VDD < 2.7 V
Cb = 100 pF, Rb = 5 k
Ω
1500
ns
2.7 V
≤ VDD ≤ 5.5 V,
Cb = 100 pF, Rb = 3 k
Ω
1/fMCK + 120
ns
Data setup time (reception)
tSU:DAT
1.8 V
≤ VDD < 2.7 V
Cb = 100 pF, Rb = 5 k
Ω
1/fMCK + 230
ns
2.7 V
≤ VDD ≤ 5.5 V,
Cb = 100 pF, Rb = 3 k
Ω
0
160
ns
Data hold time (transmission)
tHD:DAT
1.8 V
≤ VDD < 2.7 V
Cb = 100 pF, Rb = 5 k
Ω
0
210
ns
Note
The value must also be fMCK/4 or less.
(Remarks are given on the next page.)
<R>
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