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參數(shù)資料
| 型號： | UPSD3253BV-40T6 |
| 廠商： | 意法半導體 |
| 元件分類： | DC/DC變換器 |
| 英文描述： | RP30 (E) Series - Powerline Regulated DC-DC Converters; Input Voltage (Vdc): 48V; Output Voltage (Vdc): 12V; 2:1 Wide Input Voltage Range; 30 Watts Output Power; 1.6kVDC Isolation; UL Certified; Fixed Operating Frequency; Six-Sided Continuous Shield; International Safety Standard Approvals; Standard 50.8 x40.6x10.2mm Package; Efficiency to 90% |
| 中文描述： | 閃存可編程系統(tǒng)設備與8032微控制器核心和256Kbit的SRAM |
| 文件頁數(shù)： | 162/176頁 |
| 文件大?。?/td> | 1214K |
| 代理商： | UPSD3253BV-40T6 |
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μPSD325X DEVICES
162/176
Figure 82. Input Macrocell Timing (product term clock)
Table 127. Input Macrocell Timing (5V Devices)
Note: 1. Inputs from Port A, B, and C relative to register/ latch clock from the PLD. ALE/AS latch timings refer to t
AVLX
and t
LXAX
.
Table 128. Input Macrocell Timing (3V Devices)
Note: 1. Inputs from Port A, B, and C relative to register/latch clock from the PLD. ALE latch timings refer to t
AVLX
and t
LXAX
.
Symbol
Parameter
Conditions
Min
Max
PT
Aloc
Turbo
Off
Unit
t
IS
Input Setup Time
(Note
1
)
0
ns
t
IH
Input Hold Time
(Note
1
)
15
+ 10
ns
t
INH
NIB Input High Time
(Note
1
)
9
ns
t
INL
NIB Input Low Time
(Note
1
)
9
ns
t
INO
NIB Input to Combinatorial Delay
(Note
1
)
34
+ 2
+ 10
ns
Symbol
Parameter
Conditions
Min
Max
PT
Aloc
Turbo
Off
Unit
t
IS
Input Setup Time
(Note
1
)
0
ns
t
IH
Input Hold Time
(Note
1
)
25
+ 20
ns
t
INH
NIB Input High Time
(Note
1
)
12
ns
t
INL
NIB Input Low Time
(Note
1
)
12
ns
t
INO
NIB Input to Combinatorial Delay
(Note
1
)
46
+ 4
+ 20
ns
t
INH
t
INL
t
INO
t
IH
t
IS
PT CLOCK
INPUT
OUTPUT
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