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參數(shù)資料
| 型號： | V62C518256LL-70P |
| 廠商： | Mosel Vitelic, Corp. |
| 英文描述： | 32K X 8 STATIC RAM(54.75 k |
| 中文描述： | 32K的× 8靜態(tài)RAM（54.75畝 |
| 文件頁數(shù)： | 6/12頁 |
| 文件大小： | 54K |
| 代理商： | V62C518256LL-70P |
6
V62C518256 Rev. 2.3 November 1998
MOSEL V ITELIC
V62C518256
AC Electrical Characteristics
(over all temperature ranges)
Read Cycle
Write Cycle
Parameter
Name
Parameter
-35
-70
Unit
Min.
Max.
Min.
Max.
t
RC
Read Cycle Time
35
—
70
—
ns
t
AA
Address Access Time
—
35
—
70
ns
t
ACS
Chip Enable Access Time
—
35
—
70
ns
t
OE
Output Enable to Output Valid
—
15
—
30
ns
t
CLZ
Chip Enable to Output in Low Z
5
—
5
—
ns
t
OLZ
Output Enable to Output in Low Z
5
—
5
—
ns
t
CHZ
Chip Disable to Output in High Z
0
20
0
20
ns
t
OHZ
Output Disable to Output in High Z
0
20
0
20
ns
t
OH
Output Hold from Address Change
5
—
5
—
ns
Parameter
Name
Parameter
-35
-70
Unit
Min.
Max.
Min.
Max.
t
WC
Write Cycle Time
35
—
70
—
ns
t
CW
Chip Enable to End of Write
35
—
60
—
ns
t
AS
Address Setup Time
0
—
0
—
ns
t
AW
Address Valid to End of Write
35
—
60
—
ns
t
WP
Write Pulse Width
25
—
50
—
ns
t
WR
Write Recovery Time
0
—
0
—
ns
t
WHZ
Write to Output High-Z
0
20
0
25
ns
t
DW
Data Setup to End of Write
25
—
30
—
ns
t
DH
Data Hold from End of Write
0
—
0
—
ns
t
OHZ
Output Disable to Output in High Z
0
25
0
30
ns
t
OW
Output Active from End of Write
5
—
5
—
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| V62C51864L-35PI | 8K X 8 STATIC RAM |
| V62C51864 | 8K X 8 STATIC RAM |
| V6301 | Ultra Low Power 3-Pin Voltage Surveillance with Time-out |
| V6309 | 3-Pin Microprocessor Reset Circuit |
| V6310 | Ultra Low Power 3-Pin Voltage Window Surveillance with Time-out |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| V62C518256P-35L | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x8 SRAM |
| V62C518256P-35LE | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x8 SRAM |
| V62C518256P-35LI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x8 SRAM |
| V62C518256P-35LL | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x8 SRAM |
| V62C518256P-35LLE | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x8 SRAM |
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