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參數(shù)資料
| 型號： | VNC2-64L1B-TRAY |
| 廠商： | FTDI, Future Technology Devices International Ltd |
| 文件頁數(shù)： | 10/88頁 |
| 文件大小： | 0K |
| 描述： | IC USB HOST/DEVICE CTRL 64-LQFP |
| 應用說明： | Vinculum-II IO Cell Description AppNote Vinculum-II Debug Interface Description AppNote Vinculum-II IO Mux Explained AppNote Vinculum-II PWM Example AppNote Migrating Vinculum Designs AppNote |
| 標準包裝： | 160 |
| 系列： | Vinculum-II |
| 控制器類型： | USB 2.0 控制器 |
| 接口： | USB，主機/設備配置，UART，SPI，PWM，閃存 256K，DMA 4CH |
| 電源電壓： | 1.62 V ~ 1.98 V |
| 電流 - 電源： | 25mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-LQFP |
| 供應商設備封裝： | 64-LQFP（10x10） |
| 包裝： | 托盤 |
| 其它名稱： | VNC2-64L1A-TRAY VNC2-64L1A-TRAY-ND |
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18
Copyright 2009-2011 Future Technology Devices International Limited
Datasheet
Vinculum-II Embedded Dual USB Host Controller IC
Version 1.5
Document No.: FT_000138 Clearance No.: FTDI# 143
3.12 Pin Configuration Input / Output
VNC2 has multiple interfaces available for connecting to external devices. These are UART, FIFO, SPI
slave, SPI master, GPIO and PWM. The Interface I/O Multiplexer is used to share the available I/O Pins
between each peripheral.
VNC2 is configured with default settings for the I/O pins however they can be easily changed to suit the
needs of a designer. This is explained in Section 5 – I/O Multiplexer. Default configuration for each
package type is shown in Table 3.4- Default I/O Configuration. The signal names are also indicated
for the VNC1L device as it is pin-compatible with the 48 pin LQFP VNC2 device.
Note: The default value of the pins listed in the following table are only available when the I/O
Mux is enabled. A blank VNC2 chip defaults to all I/O pins as inputs.
Pin No
Name
(VINC1-L)
64 Pin
Default
48 Pin
Default
32 PIN
Default
Type
Description
64
Pin
48
Pin
32
Pin
11
IOBUS0
(BDBUS0)
debug_if
I/O
GPIO
12
IOBUS1
(BDBUS1)
Input
pwm[1]
gpio[A1]
I/O
GPIO
13
14
IOBUS2
(BDBUS2)
Input
pwm[2]
gpio[A2]
I/O
GPIO
14
15
IOBUS3
(BDBUS3)
Input
pwm[3]
gpio[A3]
I/O
GPIO
15
23
IOBUS4
(BDBUS4)
fifo_data[0]
spi_s0_clk
uart_txd
I/O
GPIO
16
24
IOBUS5
(BDBUS5)
fifo_data[1]
spi_s0_mosi
uart_rxd
I/O
GPIO
17
18
25
IOBUS6
(BDBUS6)
fifo_data[2]
spi_s0_miso
uart_rts#
I/O
GPIO
18
19
26
IOBUS7
(BDBUS7)
fifo_data[3]
spi_s0_ss#
uart_cts#
I/O
GPIO
19
20
29
IOBUS8
(BCBUS0)
fifo_data[4]
spi_m_clk
spi_s0_clk
I/O
GPIO
20
21
30
IOBUS9
(BCBUS1)
fifo_data[5]
spi_m_mosi
spi_s0_mosi
I/O
GPIO
22
31
IOBUS10
(BCBUS2)
fifo_data[6]
spi_m_miso
spi_s0_miso
I/O
GPIO
23
32
IOBUS11
(BCBUS3)
fifo_data[7]
spi_m_ss_0#
spi_s0_ss#
I/O
GPIO
24
31
-
IOBUS12
(ADBUS0)
fifo_rxf#
uart_txd
I/O
GPIO
25
32
-
IOBUS13
(ADBUS1)
fifo_txe#
uart_rxd
I/O
GPIO
26
33
-
IOBUS14
(ADBUS2)
fifo_rd#
uart_rts#
I/O
GPIO
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