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參數(shù)資料
| 型號： | VR4102 |
| 廠商： | NEC Corp. |
| 英文描述： | 64/32-bit Microprocessor |
| 中文描述： | 64/32微處理器 |
| 文件頁數(shù)： | 22/701頁 |
| 文件大?。?/td> | 2329K |
| 代理商： | VR4102 |
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LIST OF FIGURES (3/4)
Fig. No.
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Instruction Cache State Diagram...........................................................................................................
Data flow on Instruction Fetch ...............................................................................................................
Data Integrity on Load Operations.........................................................................................................
Data Integrity on Store Operations ........................................................................................................
Data Integrity on Index_Invalidate Operations.......................................................................................
Data Integrity on Index_Writeback_Invalidate Operations.....................................................................
Data Integrity on Index_Load_Tag Operations......................................................................................
Data Integrity on Index_Store_Tag Operations .....................................................................................
Data Integrity on Create_Dirty Operations.............................................................................................
Data Integrity on Hit_Invalidate Operations...........................................................................................
Data Integrity on Hit_Writeback_Invalidate Operations.........................................................................
Data Integrity on Fill Operations ............................................................................................................
Data Integrity on Hit_Writeback Operations...........................................................................................
Data Integrity on Writeback Flow...........................................................................................................
Data Integrity on Refill Flow...................................................................................................................
Data Integrity on Writeback & Refill Flow...............................................................................................
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9-1
9-2
9-3
Non-maskable Interrupt Signal ..............................................................................................................
Hardware Interrupt Signals....................................................................................................................
Masking of the CPU Core Interrupts......................................................................................................
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10-22
10-23
ROM 4-byte Read, 16-bit Mode (WROMA[2:0] = 110)...........................................................................
ROM 4-byte Read, 32-bit Mode (WROMA[2:0] = 110)...........................................................................
PageROM 4-word Read, 16-bit Mode (WROMA[2:0] = 111, WPROM[1:0] = 10)..................................
PageROM 4-word Read, 32-bit Mode (WROMA[2:0] = 111, WPROM[1:0] = 10)..................................
Flash Memory Mode, 2-byte Access......................................................................................................
1-byte Access to Even Address Using 16-bit Bus (WISAA[2:0] = 101)..................................................
2-byte Access when Sampling IOCHRDY at High Level Using 16-bit Bus (WISAA[2:0] = 101)............
1-byte Access to Odd Address Using 16-bit Bus (WISAA[2:0] = 101)...................................................
1-byte Access to Odd Address Using 8-bit Bus (WISAA[2:0] = 101).....................................................
2-byte Access when Sampling ZWS# at Low Level on 16-bit Bus (WISAA[2:0] = 101) ........................
2-byte Access when Sampling ZWS# at Low Level on 8-bit Bus (WISAA[2:0] = 101) ..........................
2-byte Access on 16-bit Bus (WLCD/M[2:0] = 101)...............................................................................
1-byte Access on 8-bit Bus (WLCD/M[2:0] = 101).................................................................................
2-byte Access When Sampling ZWS# at Low Level on 16-bit Bus (WLCD/M[2:0] = 101).....................
1-byte Access When Sampling ZWS# at Low Level on 8-bit Bus (WLCD/M[2:0] = 101).......................
2-byte Access to LCD Controller (WLCD/M[2:0] = 010).........................................................................
2-byte Access to LCD Controller (WLCD/M[2:0] = 011).........................................................................
4-byte Access to DRAM (16-bit Mode) ..................................................................................................
8-byte Access to DRAM (32-bit Mode) ..................................................................................................
Byte Read of Odd Address in DRAM (16-bit Mode)...............................................................................
Byte Read of Even Address in DRAM (16-bit Mode).............................................................................
Byte Write to Odd Address in DRAM (16-bit Mode)...............................................................................
Byte Write to Even Address in DRAM (16-bit Mode) .............................................................................
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相關PDF資料 |
PDF描述 |
|---|---|
| VR42050 | CONVERTER, DC/DC, 1O/P, 15W, 12V; Power rating:15W; DC/DC Converter O/P type:Single; Voltage, input max:75V dc; Voltage, input min:18V dc; Voltage, output:12V dc; Depth, external:11.30mm; Length / Height, external:25.4mm; Width, RoHS Compliant: Yes |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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| VR41S00B-00000-000 | 制造商:Carling Technologies 功能描述:V-SERIES ROCKER SWITCH - Bulk |
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| VR42SW0X-UZX00-0-XME1 | 制造商:Carling Technologies 功能描述:V-SERIES ROCKER SWITCH - Bulk |
| VR42U111-1RE00-000 | 制造商:Carling Technologies 功能描述:V-SERIES ROCKER SWITCH - Bulk |
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