參數(shù)資料
型號(hào)： X9221AUST1
廠(chǎng)商： Intersil
文件頁(yè)數(shù)： 3/15頁(yè)
文件大?。?/td> 0K
描述： IC XDCP DUAL 50K 2-WIRE 20-SOIC
標(biāo)準(zhǔn)包裝： 1,000
系列： XDCP™
接片： 64
電阻（歐姆）： 50k
電路數(shù)： 2
溫度系數(shù)： 標(biāo)準(zhǔn)值 ±300 ppm/°C
存儲(chǔ)器類(lèi)型： 非易失
接口： I²C（設(shè)備位址）
電源電壓： 4.5 V ~ 5.5 V
工作溫度： 0°C ~ 70°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 20-SOIC（0.295"，7.50mm 寬）
供應(yīng)商設(shè)備封裝： 20-SOIC W
包裝： 帶卷 (TR)
WAVEFORM
INPUTS
OUTPUTS
Must be
steady
Will be
steady
May change
from LOW
to HIGH
Will change
from LOW
to HIGH
May change
from HIGH
to LOW
Will change
from HIGH
to LOW
Don’t Care:
Changes
Allowed
Changing:
State Not
Known
N/A
Center Line
is High
Impedance
5V
1533
Ω
100pF
SDA Output
RH
CH
10pF
CW
RL
CL
RW
RTOTAL
25pF
10pF
Macro Model
120
100
80
40
60
20
20 40 60
80 100 120
0
Bus Capacitance (pF)
Min.
Resistance
Max.
Resistance
RMAX =
CBUS
tR
RMIN =
IOL MIN
VCC MAX
=1.8k
Ω
R
esistan
ce
(k
Ω
)
11
FN8163.2
August 30, 2006
A.C. CONDITIONS OF TEST
SYMBOL TABLE
Equivalent A.C. Test Circuit
Circuit #3 SPICE Macro Model
Guidelines for Calculating Typical Values of Bus
Pull-Up Resistors
Input pulse levels
VCC x 0.1 to VCC x 0.9
Input rise and fall times
10ns
Input and output timing levels
VCC x 0.5
X9221A
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PDF描述
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