參數資料
| 型號： | X9221AWST1 |
| 廠商： | Intersil |
| 文件頁數： | 11/15頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC XDCP DUAL 10K 2-WIRE 20-SOIC |
| 標準包裝： | 1,000 |
| 系列： | XDCP™ |
| 接片： | 64 |
| 電阻（歐姆）： | 10k |
| 電路數： | 2 |
| 溫度系數： | 標準值 ±300 ppm/°C |
| 存儲器類型： | 非易失 |
| 接口： | I²C（設備位址） |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-SOIC（0.295"，7.50mm 寬） |
| 供應商設備封裝： | 20-SOIC W |
| 包裝： | 帶卷 (TR) |
S
T
A
R
T
0101
A3 A2 A1 A0
A
I3
I2
I1
I0
0
P0 R1 R0
SCL
SDA
S
T
O
P
C
K
A
C
K
S
T
A
R
T
0
1
0
1 A3 A2 A1 A0 A
I3 I2
I1 I0
0 P0 R1 R0
SCL
SDA
S
T
O
P
0
D5 D4 D3 D2 D1 D0
C
K
A
C
K
A
C
K
5
FN8163.2
August 30, 2006
tuning capability to the host. For each SCL clock pulse
(tHIGH) while SDA is HIGH, the selected wiper will
move one resistor segment towards the VH/RH termi-
nal. Similarly, for each SCL clock pulse while SDA is
LOW, the selected wiper will move one resistor seg-
ment towards the VL/RL terminal. A detailed illustra-
tion of the sequence and timing for this operation are
shown in Figures 5 and 6 respectively.
Figure 3. Two-Byte Command Sequence
Figure 4. Three-Byte Command Sequence
Figure 5. Increment/Decrement Command Sequined
e
S
T
A
R
T
0
1
0
1 A3 A2 A1 A0
I3
I2
I1 I0
0
P0 R1 R0
SCL
SDA
S
T
O
P
X
I
N
C
1
I
N
C
2
I
N
C
n
D
E
C
1
D
E
C
n
A
C
K
A
C
K
X9221A
相關PDF資料 |
PDF描述 |
|---|---|
| X9221AWSIT1 | IC XDCP DUAL 10K 2-WIRE 20-SOIC |
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| X9221AWSI | IC XDCP DUAL 10K 2-WIRE 20-SOIC |
| VI-BNP-MV-S | CONVERTER MOD DC/DC 13.8V 150W |
| VE-27Y-MY-F4 | CONVERTER MOD DC/DC 3.3V 33W |
相關代理商/技術參數 |
參數描述 |
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