參數(shù)資料
型號(hào)： X9252US24I-2.7
廠商： INTERSIL CORP
元件分類： 數(shù)字電位計(jì)
英文描述： Low Power + Quad 256-Tap + 2-Wire Bus + Up/Down Interface
中文描述： QUAD 50K DIGITAL POTENTIOMETER, 2-WIRE SERIAL CONTROL INTERFACE, 256 POSITIONS, PDSO24
封裝： PLASTIC, SOIC-24
文件頁數(shù)： 6/21頁
文件大?。?/td> 126K
代理商： X9252US24I-2.7
6 of 21
REV 1.4.1 7/29/03
www.xicor.com
X9252
2-WIRE INTERFACE TIMING(S)
SDA vs. SCL Timing
WP, A0, A1, and A2 Pin Timing
Symbol
f
SCL
t
HIGH
t
LOW
t
SU:STA
t
HD:STA
t
SU:STO
t
SU:DAT
t
HD:DAT
t
R
(5)
t
F
(5)
t
AA
(5)
t
DH
t
IN
(5)
t
BUF
(5)
t
SU:WPA
(5)
t
HD:WPA
(5)
Parameter
Min.
Max.
400
Units
kHz
ns
ns
ns
ns
ns
ns
ns
ns
ns
μs
ns
ns
ns
ns
ns
Clock Frequency
Clock High Time
Clock Low Time
Start Condition Setup Time
Start Condition Hold Time
Stop Condition Setup Time
SDA Data Input Setup Time
SDA Data Input Hold Time
SCL and SDA Rise Time
SCL and SDA Fall Time
SCL Low to SDA Data Output Valid Time
SDA Data Output Hold Time
Pulse Width Suppression Time at SCL and SDA inputs
Bus Free Time (Prior to Any Transmission)
A0, A1, A2 and WP Setup Time
A0, A1, A2 and WP Hold Time
600
1300
600
600
600
100
30
300
300
0.9
0
50
1200
600
600
t
SU:STO
t
DH
t
HIGH
t
SU:STA
t
HD:STA
t
HD:DAT
t
SU:DAT
SCL
SDA
(Input Timing)
SDA
(Output Timing)
t
F
t
LOW
t
BUF
t
AA
t
R
t
HD:WP
SCL
SDA IN
WP, A0, A1, or A2
t
SU:WP
Clk 1
START
STOP
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PDF描述
X9252US24IZ-2.7 Low Power + Quad 256-Tap + 2-Wire Bus + Up/Down Interface
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X9252YV24IZ-2.7 Low Power + Quad 256-Tap + 2-Wire Bus + Up/Down Interface
X9252WV24IZ-2.7 KIT RF SHIELD LARGE MULTI-HEIGHT
X9252UV24IZ-2.7 KIT RF SHIELD SMALL MULTI-HEIGHT
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X9252WAZ WAF 制造商:Intersil Corporation 功能描述:
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