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參數(shù)資料
| 型號： | X9409WV24I-2.7T1 |
| 廠商： | Intersil |
| 文件頁數(shù)： | 6/20頁 |
| 文件大小： | 0K |
| 描述： | IC XDCP QUAD 64-TAP 10K 24-TSSOP |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 系列： | XDCP™ |
| 接片： | 64 |
| 電阻（歐姆）： | 10k |
| 電路數(shù)： | 4 |
| 溫度系數(shù)： | 標(biāo)準(zhǔn)值 ±300 ppm/°C |
| 存儲器類型： | 非易失 |
| 接口： | I²C（設(shè)備位址） |
| 電源電壓： | 2.7 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 24-TSSOP |
| 包裝： | 帶卷 (TR) |
14
FN8192.4
October 12, 2006
XDCP TIMING
Note: (9) A device must internally provide a hold time of at least 300ns for the SDA signal in order to bridge the undefined region of the falling
edge of SCL.
TIMING DIAGRAMS
START and STOP Timing
g
Input Timing
Output Timing
Symbol
Parameter
Min.
Typ.
Max.
Unit
tWRPO
Wiper response time after the third (last) power supply is stable
2
10
s
tWRL
Wiper response time after instruction issued (all load instructions)
2
10
s
tWRID
Wiper response time from an active SCL/SCK edge (increment/decrement
instruction)
210
s
tSU:STA
tHD:STA
tSU:STO
SCL
SDA
tR
(START)
(STOP)
tF
tR
tF
SCL
SDA
tHIGH
tLOW
tCYC
tHD:DAT
tSU:DAT
tBUF
SCL
SDA
tDH
tAA
X9409
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