參數(shù)資料
| 型號： | X9420YS16-2.7 |
| 廠商： | Intersil |
| 文件頁數(shù)： | 6/19頁 |
| 文件大小： | 0K |
| 描述： | IC XDCP SGL 64-TAP 2.5K 16-SOIC |
| 標準包裝： | 47 |
| 系列： | XDCP™ |
| 接片： | 64 |
| 電阻（歐姆）： | 2.5k |
| 電路數(shù)： | 1 |
| 溫度系數(shù)： | 標準值 ±300 ppm/°C |
| 存儲器類型： | 非易失 |
| 接口： | 5 線 SPI（芯片選擇，設備位址） |
| 電源電壓： | 2.7 V ~ 5.5 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-SOIC（0.295"，7.50mm 寬） |
| 供應商設備封裝： | 16-SOIC |
| 包裝： | 管件 |
14
FN8195.1
April 26, 2006
HIGH-VOLTAGE WRITE CYCLE TIMING
XDCP TIMING
SYMBOL TABLE
Symbol
Parameter
Typ.
Max.
Units
tWR
High-voltage Write Cycle Time (Store Instructions)
5
10
ms
Symbol
Parameter
Min.
Max. Units
tWRPO
Wiper Response Time After The Third (Last) Power Supply Is Stable
10
s
tWRL
Wiper Response Time After Instruction Issued (All Load Instructions)
10
s
tWRID
Wiper Response Time From An Active SCL/SCK Edge (Increment/Decrement
Instruction)
450
ns
WAVEFORM
INPUTS
OUTPUTS
Must be
steady
Will be
steady
May change
from Low to
High
Will change
from Low to
High
May change
from High to
Low
Will change
from High to
Low
Don’t Care:
Changes
Allowed
Changing:
State Not
Known
N/A
Center Line
is High
Impedance
X9420
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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