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參數(shù)資料
| 型號： | X98014 |
| 廠商： | Intersil Corporation |
| 英文描述： | 140MHz Triple Video Digitizer with Digital DLL(帶有數(shù)字PLL的140MHz三路視頻信號數(shù)字轉(zhuǎn)換器) |
| 中文描述： | 140MHz的三路視頻數(shù)字化與數(shù)字DLL（帶有數(shù)字鎖相環(huán)的140MHz的三路視頻信號數(shù)字轉(zhuǎn)換器） |
| 文件頁數(shù)： | 7/29頁 |
| 文件大?。?/td> | 444K |
| 代理商： | X98014 |
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7
FN8217.3
March 8, 2006
t
HSYNCin-to-HSout
= 7.5ns + (PHASE/64 +10.5)*t
PIXEL
D
1
D
3
Programmable
Width and Polarity
Analog
Video In
P
1
P
2
P
3
P
4
P
5
P
6
P
7
P
8
P
0
P
9
D
0
R
P
/G
P
/B
P
[7:0]
HS
OUT
P
10
P
11
P
12
D
2
The HSYNC edge (programmable leading or trailing) that the DPLL is locked to.
The sampling phase setting determines its relative position to the rest of the AFE’s output signals
DATACLK
R
S
/G
S
/B
S
[7:0]
HSYNC
IN
The HSYNC edge (programmable leading or trailing) that the DPLL is locked to.
HSYNC
FIGURE 5. 48 BIT OUTPUT MODE
Programmable
Width and Polarity
Analog
Video In
P
1
P
2
P
3
P
4
P
5
P
6
P
7
P
8
P
0
P
9
HS
OUT
P
10
P
11
The HSYNC edge (programmable leading or trailing) that the DPLL is locked to.
The sampling phase setting determines its relative position to the rest of the AFE’s output signals
DATACLK
HSYNC
IN
D
0
R
P
/G
P
/B
P
[7:0]
D
2
D
1
R
S
/G
S
/B
S
[7:0]
t
HSYNCin-to-HSout
= 7.5ns + (PHASE/64 +8.5)*t
PIXEL
FIGURE 6. 48 BIT OUTPUT MODE, INTERLEAVED TIMING
X98014
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| X98017 | 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:170MHz Triple Video Digitizer with Digital PLL |
| X98017_06 | 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:170MHz Triple Video Digitizer with Digital PLL |
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