參數(shù)資料
型號(hào)： XC2S30-6TQ144C
廠商： Xilinx Inc
文件頁數(shù)： 61/99頁
文件大?。?/td> 0K
描述： IC FPGA 2.5V C-TEMP 144-TQFP
標(biāo)準(zhǔn)包裝： 60
系列： Spartan®-II
LAB/CLB數(shù)： 216
邏輯元件/單元數(shù)： 972
RAM 位總計(jì)： 24576
輸入/輸出數(shù)： 92
門數(shù)： 30000
電源電壓： 2.375 V ~ 2.625 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-TQFP（20x20）
Spartan-II FPGA Family: DC and Switching Characteristics
DS001-3 (v2.8) June 13, 2008
Module 3 of 4
Product Specification
64
R
CLB Switching Characteristics
Delays originating at F/G inputs vary slightly according to the input used. The values listed below are worst-case. Precise
values are provided by the timing analyzer.
Symbol
Description
Speed Grade
Units
-6
-5
Min
Max
Min
Max
Combinatorial Delays
TILO
4-input function: F/G inputs to X/Y outputs
-
0.6
-
0.7
ns
TIF5
5-input function: F/G inputs to F5 output
-
0.7
-
0.9
ns
TIF5X
5-input function: F/G inputs to X output
-
0.9
-
1.1
ns
TIF6Y
6-input function: F/G inputs to Y output via F6 MUX
-
1.0
-
1.1
ns
TF5INY
6-input function: F5IN input to Y output
-
0.4
-
0.4
ns
TIFNCTL
Incremental delay routing through transparent latch
to XQ/YQ outputs
-
0.7
-
0.9
ns
TBYYB
BY input to YB output
-
0.6
-
0.7
ns
Sequential Delays
TCKO
FF clock CLK to XQ/YQ outputs
-
1.1
-
1.3
ns
TCKLO
Latch clock CLK to XQ/YQ outputs
-
1.2
-
1.5
ns
Setup/Hold Times with Respect to Clock CLK(1)
TICK / TCKI
4-input function: F/G inputs
1.3 / 0
-
1.4 / 0
-
ns
TIF5CK / TCKIF5
5-input function: F/G inputs
1.6 / 0
-
1.8 / 0
-
ns
TF5INCK / TCKF5IN
6-input function: F5IN input
1.0 / 0
-
1.1 / 0
-
ns
TIF6CK / TCKIF6
6-input function: F/G inputs via F6 MUX
1.6 / 0
-
1.8 / 0
-
ns
TDICK / TCKDI
BX/BY inputs
0.8 / 0
-
0.8 / 0
-
ns
TCECK / TCKCE
CE input
0.9 / 0
-
0.9 / 0
-
ns
TRCK / TCKR
SR/BY inputs (synchronous)
0.8 / 0
-
0.8 / 0
-
ns
Clock CLK
TCH
Minimum pulse width, High
-
1.9
-
1.9
ns
TCL
Minimum pulse width, Low
-
1.9
-
1.9
ns
Set/Reset
TRPW
Minimum pulse width, SR/BY inputs
3.1
-
3.1
-
ns
TRQ
Delay from SR/BY inputs to XQ/YQ outputs
(asynchronous)
-
1.1
-
1.3
ns
TIOGSRQ
Delay from GSR to XQ/YQ outputs
-
9.9
-
11.7
ns
FTOG
Toggle frequency (for export control)
-
263
-
263
MHz
Notes:
1.
A zero hold time listing indicates no hold time or a negative hold time.
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XC2S30-6VQ100I 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-II 2.5V FPGA Family:Introduction and Ordering Information
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