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參數(shù)資料
| 型號： | XC2V4000-4FFG1517C |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 245/318頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA VIRTEX-II 4M 1517-FBGA |
| 產(chǎn)品變化通告： | FPGA Family Discontinuation 18/Apr/2011 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | Virtex®-II |
| LAB/CLB數(shù)： | 5760 |
| RAM 位總計： | 2211840 |
| 輸入/輸出數(shù)： | 912 |
| 門數(shù)： | 4000000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 1517-BBGA，F(xiàn)CBGA |
| 供應(yīng)商設(shè)備封裝： | 1517-FCBGA（40x40） |
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Virtex-II Platform FPGAs: Functional Description
R
DS031-2 (v3.5) November 5, 2007
Module 2 of 4
Product Specification
24
3.
“NO_CHANGE”
The “NO_CHANGE” option maintains the content of the
output registers, regardless of the write operation. The
clock edge during the write mode has no effect on the
content of the data output register DO. When the port is
configured as “NO_CHANGE”, only a read operation
loads a new value in the output register DO, as shown in
Control Pins and Attributes
Virtex-II SelectRAM memory has two independent ports
with the control signals described in Table 17. All control
inputs including the clock have an optional inversion.
Initial memory content is determined by the INIT_xx
attributes. Separate attributes determine the output register
value after device configuration (INIT) and SSR is asserted
(SRVAL). Both attributes (INIT_B and SRVAL) are available
for each port when a block SelectRAM resource is config-
ured as dual-port RAM.
Locations
Virtex-II SelectRAM memory blocks are located in either
four or six columns. The number of blocks per column
depends of the device array size and is equivalent to the
number of CLBs in a column divided by four. Column loca-
tions are shown in Table 18.
Figure 33: NO_CHANGE Mode
Table 17: Control Functions
Control Signal
Function
CLK
Read and Write Clock
EN
Enable affects Read, Write, Set, Reset
WE
Write Enable
SSR
Set DO register to SRVAL (attribute)
CLK
WE
Data_in
New
aa
Last Read Cycle Content (no change)
Address
Internal
Memory
DO
No change during write
Data_out
DI
DS031_12_102000
RAM Contents
New
Old
Table 18: SelectRAM Memory Floor Plan
Device
Columns
SelectRAM Blocks
Per Column
Total
XC2V40
2
4
XC2V80
2
4
8
XC2V250
4
6
24
XC2V500
4
8
32
XC2V1000
4
10
40
XC2V1500
4
12
48
XC2V2000
4
14
56
XC2V3000
6
16
96
XC2V4000
6
20
120
XC2V6000
6
24
144
XC2V8000
6
28
168
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XC2V4000-4FFG1152C | IC FPGA VIRTEX-II 4M 1152-FBGA |
| HMC49DRYH-S734 | CONN EDGECARD 98POS DIP .100 SLD |
| XC6VCX240T-1FFG1156I | IC FPGA VIRTEX 6 241K 1156FFGBGA |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XC2V4000-4FFG1517I | 功能描述:IC FPGA VIRTEX-II 4M 1517-FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Virtex®-II 產(chǎn)品變化通告:XC4000(E,L) Discontinuation 01/April/2002 標(biāo)準(zhǔn)包裝:24 系列:XC4000E/X LAB/CLB數(shù):100 邏輯元件/單元數(shù):238 RAM 位總計:3200 輸入/輸出數(shù):80 門數(shù):3000 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:120-BCBGA 供應(yīng)商設(shè)備封裝:120-CPGA（34.55x34.55） |
| XC2V4000-4FG256C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-II Platform FPGAs: Complete Data Sheet |
| XC2V4000-4FG256I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-II Platform FPGAs: Complete Data Sheet |
| XC2V4000-4FG456C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-II Platform FPGAs: Complete Data Sheet |
| XC2V4000-4FG456I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-II Platform FPGAs: Complete Data Sheet |
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