參數(shù)資料
型號： XC2V8000-4FFG1152I
廠商： Xilinx Inc
文件頁數(shù)： 272/318頁
文件大?。?/td> 0K
描述： IC FPGA VIRTEX-II 8M 1152-FBGA
標準包裝： 1
系列： Virtex®-II
LAB/CLB數(shù)： 11648
RAM 位總計： 3096576
輸入/輸出數(shù)： 824
門數(shù)： 8000000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 1152-BBGA，F(xiàn)CBGA
供應(yīng)商設(shè)備封裝： 1152-FCBGA（35x35）
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Virtex-II Platform FPGAs: DC and Switching Characteristics
R
DS031-3 (v3.5) November 5, 2007
Module 3 of 4
Product Specification
9
Virtex-II Switching Characteristics
Switching characteristics in this document are specified on
a per-speed-grade basis and can be designated as
Advance, Preliminary, or Production. Note that Virtex-II Per-
guidelines as well. Each designation is defined as follows:
Advance: These speed files are based on simulations only
and are typically available soon after device design specifi-
cations are frozen. Although speed grades with this desig-
nation are considered relatively stable and conservative,
some under-reporting might still occur.
Preliminary: These speed files are based on complete ES
(engineering sample) silicon characterization. Devices and
speed grades with this designation are intended to give a
better indication of the expected performance of production
silicon. The probability of under-reporting delays is greatly
reduced as compared to Advance data.
Production: These speed files are released once enough
production silicon of a particular device family member has
been characterized to provide full correlation between
speed files and devices over numerous production lots.
There is no under-reporting of delays, and customers
receive formal notification of any subsequent changes. Typ-
ically, the slowest speed grades transition to Production
before faster speed grades.
Since individual family members are produced at different
times, the migration from one category to another depends
completely on the status of the fabrication process for each
device. Table 13 correlates the current status of each
Virtex-II device with a corresponding speed grade designa-
tion.
All specifications are always representative of worst-case
supply voltage and junction temperature conditions.
Testing of Switching Characteristics
All devices are 100% functionally tested. Internal timing
parameters are derived from measuring internal test pat-
terns. Listed below are representative values. For more
specific, more precise, and worst-case guaranteed data,
use the values reported by the Xilinx static timing analyzer
and back-annotate to the simulation net list. Unless other-
wise noted, values apply to all Virtex-II devices.
IOB Input Switching Characteristics
Input delays associated with the pad are specified for
LVTTL levels. For other standards, adjust the delays with
Table 13: Virtex-II Device Speed Grade Designations
Device
Speed Grade Designations
Advance
Preliminary
Production
XC2V40
-6, -5, -4
XC2V80
-6, -5, -4
XC2V250
-6, -5, -4
XC2V500
-6, -5, -4
XC2V1000
-6, -5, -4
XC2V1500
-6, -5, -4
XC2V2000
-6, -5, -4
XC2V3000
-6, -5, -4
XC2V4000
-6, -5, -4
XC2V6000
-6, -5, -4
XC2V8000
-5, -4
Table 14: IOB Input Switching Characteristics
Speed Grade
Units
Description
Symbol
Device
-6
-5
-4
Propagation Delays
Pad to I output, no delay
TIOPI
All
0.69
0.76
0.88
ns, Max
Pad to I output, with delay
TIOPID
XC2V40
1.92
2.11
2.43
ns, Max
XC2V80
1.92
2.11
2.43
ns, Max
XC2V250
1.92
2.11
2.43
ns, Max
XC2V500
1.92
2.11
2.43
ns, Max
XC2V1000
1.92
2.11
2.43
ns, Max
XC2V1500
1.92
2.11
2.43
ns, Max
XC2V2000
1.92
2.11
2.43
ns, Max
XC2V3000
1.97
2.16
2.49
ns, Max
XC2V4000
1.97
2.16
2.49
ns, Max
XC2V6000
2.10
2.31
2.66
ns, Max
XC2V8000
2.31
2.66
ns, Max
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PDF描述
3-84534-0 CONN FFC 30POS 1.25MM VERT T/H
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