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參數(shù)資料
| 型號： | XC4005E-4TQ144I |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 2/68頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA I-TEMP 5V 4-SPD 144-TQFP |
| 產(chǎn)品變化通告： | Product Discontinuation 28/Jul/2010 |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 系列： | XC4000E/X |
| LAB/CLB數(shù)： | 196 |
| 邏輯元件/單元數(shù)： | 466 |
| RAM 位總計： | 6272 |
| 輸入/輸出數(shù)： | 112 |
| 門數(shù)： | 5000 |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 144-LQFP |
| 供應(yīng)商設(shè)備封裝： | 144-TQFP（20x20） |
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R
XC4000E and XC4000X Series Field Programmable Gate Arrays
6-14
May 14, 1999 (Version 1.6)
G'
4
G1 G4
F1 F4
C1 C4
WRITE
DECODER
1 of 16
DIN
16-LATCH
ARRAY
X6752
4
MUX
F'
WRITE
DECODER
1 of 16
DIN
16-LATCH
ARRAY
READ
ADDRESS
READ
ADDRESS
WRITE PULSE
LATCH
ENABLE
LATCH
ENABLE
K
(CLOCK)
WE
D1
D0
EC
WRITE PULSE
MUX
4
Figure 4:
16x2 (or 16x1) Edge-Triggered Single-Port RAM
G'
4
G1 G4
F1 F4
C1 C4
WRITE
DECODER
1 of 16
DIN
16-LATCH
ARRAY
X6754
4
MUX
F'
WRITE
DECODER
1 of 16
DIN
16-LATCH
ARRAY
READ
ADDRESS
READ
ADDRESS
WRITE PULSE
LATCH
ENABLE
LATCH
ENABLE
K
(CLOCK)
WE
D1/A4
D0
EC
WRITE PULSE
MUX
4
H'
Figure 5: 32x1 Edge-Triggered Single-Port RAM (F and G addresses are identical)
Product Obsolete or Under Obsolescence
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AMM31DRMT-S288 | CONN EDGECARD 62POS .156 EXTEND |
| XC4005E-4TQ144C | IC FPGA C-TEMP 5V 4-SPD 144-TQFP |
| XC4005E-4PQ208I | IC FPGA I-TEMP 5V 4-SPD 208-PQFP |
| FMC17DREN-S734 | CONN EDGECARD 34POS .100 EYELET |
| XC4005E-4PQ208C | IC FPGA C-TEMP 5V 4-SPD 208-PQFP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XC4005H | 制造商:XILINX 制造商全稱:XILINX 功能描述:Logic Cell Array Families |
| XC4005H-4MQ240C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| XC4005H-4PG223C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| XC4005H-4PQ240C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| XC4005H-5MQ240C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
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