參數(shù)資料
型號(hào)： XC4025E-4PG299I
廠商： Xilinx Inc
文件頁數(shù)： 55/68頁
文件大小： 0K
描述： IC FPGA I-TEMP 5V 4 SPD 299-CPGA
產(chǎn)品變化通告： XC4000(E,L) Discontinuation 01/April/2002
標(biāo)準(zhǔn)包裝： 10
系列： XC4000E/X
LAB/CLB數(shù)： 1024
邏輯元件/單元數(shù)： 2432
RAM 位總計(jì)： 32768
輸入/輸出數(shù)： 256
門數(shù)： 25000
電源電壓： 4.5 V ~ 5.5 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 299-BCBGA
供應(yīng)商設(shè)備封裝： 299-CPGA（52.3x52.3）
R
May 14, 1999 (Version 1.6)
6-63
XC4000E and XC4000X Series Field Programmable Gate Arrays
6
Figure 55: Master Parallel Mode Programming Switching Characteristics
Address for Byte n
Byte
2 TDRC
Address for Byte n + 1
D7
D6
A0-A17
(output)
D0-D7
RCLK
(output)
CCLK
(output)
DOUT
(output)
1 TRAC
7 CCLKs
CCLK
3 TRCD
Byte n - 1
X6078
Description
Symbol
Min
Max
Units
RCLK
Delay to Address valid
1
TRAC
0
200
ns
Data setup time
2
TDRC
60
ns
Data hold time
3
TRCD
0ns
Notes:
1. At power-up, Vcc must rise from 2.0 V to Vcc min in less than 25 ms, otherwise delay conguration by pulling PROGRAM
Low until Vcc is valid.
2. The rst Data byte is loaded and CCLK starts at the end of the rst RCLK active cycle (rising edge).
This timing diagram shows that the EPROM requirements are extremely relaxed. EPROM access time can be longer than
500 ns. EPROM data output has no hold-time requirements.
Product Obsolete or Under Obsolescence
相關(guān)PDF資料
PDF描述
XC4025E-4PG299C IC FPGA C-TEMP 5V 4 SPD 299-CPGA
IDT7015S12J IC SRAM 72KBIT 12NS 68PLCC
IDT7016S35PF IC SRAM 144KBIT 35NS 80TQFP
IDT7016S25PF IC SRAM 144KBIT 25NS 80TQFP
MC7448HX1420LD IC MPU RISC 32BIT 360-FCCBGA
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參數(shù)描述
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XC4028EX-3HQ208I 制造商:Xilinx 功能描述:
XC4028EX-3HQ240C 制造商:Xilinx 功能描述:
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