參數(shù)資料
型號(hào)： XC5VLX30-1FF676I
廠商： Xilinx Inc
文件頁數(shù)： 3/91頁
文件大?。?/td> 0K
描述： IC FPGA VIRTEX-5 30K 676FBGA
標(biāo)準(zhǔn)包裝： 1
系列： Virtex®-5 LX
LAB/CLB數(shù)： 2400
邏輯元件/單元數(shù)： 30720
RAM 位總計(jì)： 1179648
輸入/輸出數(shù)： 400
電源電壓： 0.95 V ~ 1.05 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 676-BBGA，F(xiàn)CBGA
供應(yīng)商設(shè)備封裝： 676-FCBGA（27x27）
配用： 568-5088-ND - BOARD DEMO DAC1408D750
HW-AFX-FF676-500-G-ND - BOARD DEV VIRTEX 5 FF676
Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
DS202 (v5.3) May 5, 2010
Product Specification
11
Table 17: Processor Block DMA0 Switching Characteristics
Clock Name
Description
Reference Clock
Speed Grade
Units
-3
-2
-1
Clock-to-out and setup relative to clock
TCK_CONTROL
CPMDMA0LLCLK
1.256
1.42
1.665
ps
TCK_DATA
CPMDMA0LLCLK
1.312
1.472
1.712
ps
TCONTROL_CK
CPMDMA0LLCLK
0.453
0.558
0.716
ps
TDATA_CK
CPMDMA0LLCLK
–0.105
–0.104
ps
Table 18: Processor Block DMA1 Switching Characteristics
Clock Name
Description
Reference Clock
Speed Grade
Units
-3
-2
-1
Clock-to-out and setup relative to clock
TCK_CONTROL
CPMDMA1LLCLK
1.127
1.266
1.474
ps
TCK_DATA
CPMDMA1LLCLK
1.266
1.418
1.645
ps
TCONTROL_CK
CPMDMA1LLCLK
0.447
0.555
0.717
ps
TDATA_CK
CPMDMA1LLCLK
–0.014
0.01
0.046
ps
Table 19: Processor Block DMA2 Switching Characteristics
Clock Name
Description
Reference Clock
Speed Grade
Units
-3
-2
-1
Clock-to-out and setup relative to clock
TCK_CONTROL
CPMDMA2LLCLK
1.101
1.235
1.437
ps
TCK_DATA
CPMDMA2LLCLK
1.127
1.262
1.463
ps
TCONTROL_CK
CPMDMA2LLCLK
0.771
0.924
1.155
ps
TDATA_CK
CPMDMA2LLCLK
0.135
0.142
0.168
ps
Table 20: Processor Block DMA3 Switching Characteristics
Clock Name
Description
Reference Clock
Speed Grade
Units
-3
-2
-1
Clock-to-out and setup relative to clock
TCK_CONTROL
CPMDMA3LLCLK
1.094
1.242
1.462
ps
TCK_DATA
CPMDMA3LLCLK
1.056
1.184
1.376
ps
TCONTROL_CK
CPMDMA3LLCLK
0.636
0.767
0.965
ps
TDATA_CK
CPMDMA3LLCLK
0.087
0.119
0.116
ps
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