參數(shù)資料
型號(hào)： XC5VSX35T-2FFG665C
廠商： Xilinx Inc
文件頁數(shù)： 36/91頁
文件大?。?/td> 0K
描述： IC FPGA VIRTEX-5 35K 665FCBGA
標(biāo)準(zhǔn)包裝： 1
系列： Virtex®-5 SXT
LAB/CLB數(shù)： 2720
邏輯元件/單元數(shù)： 34816
RAM 位總計(jì)： 3096576
輸入/輸出數(shù)： 360
電源電壓： 0.95 V ~ 1.05 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 665-BBGA，F(xiàn)CBGA
供應(yīng)商設(shè)備封裝： 665-FCBGA
配用： 568-5088-ND - BOARD DEMO DAC1408D750
Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
DS202 (v5.3) May 5, 2010
Product Specification
41
Table 61: OLOGIC Switching Characteristics
Symbol
Description
Speed Grade
Units
-3
-2
-1
Setup/Hold
TODCK/TOCKD
D1/D2 pins Setup/Hold with respect to CLK
0.30
–0.21
0.36
–0.21
0.44
–0.21
ns
TOOCECK/TOCKOCE
OCE pin Setup/Hold with respect to CLK
0.16
–0.07
0.19
–0.07
0.23
–0.07
ns
TOSRCK/TOCKSR
SR/REV pin Setup/Hold with respect to CLK
0.93
–0.20
1.02
–0.20
1.16
–0.20
ns
TOTCK/TOCKT
T1/T2 pins Setup/Hold with respect to CLK
0.28
–0.18
0.34
–0.18
0.41
–0.18
ns
TOTCECK/TOCKTCE
TCE pin Setup/Hold with respect to CLK
0.20
–0.06
0.23
–0.06
0.29
–0.06
ns
Combinatorial
TDOQ
D1 to OQ out or T1 to TQ out
0.62
0.70
0.83
ns
Sequential Delays
TOCKQ
CLK to OQ/TQ out
0.61
0.62
ns
TRQ
SR/REV pin to OQ/TQ out
1.63
1.89
2.27
ns
TGSRQ
Global Set/Reset to Q outputs
7.30
10.10
ns
Set/Reset
TRPW
Minimum Pulse Width, SR/REV inputs
0.80
0.98
1.25
ns, Min
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PDF描述
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ASM40DTBH-S189 CONN EDGECARD 80POS R/A .156 SLD
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