參數資料
| 型號： | XC6VCX130T-1FFG484I |
| 廠商： | Xilinx Inc |
| 文件頁數： | 52/52頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA VIRTEX 6 128K 484FFGBGA |
| 產品培訓模塊： | Virtex-6 FPGA Overview |
| 產品變化通告： | Virtex-6 FIFO Input Logic Reset 18/Apr/2011 |
| 標準包裝： | 1 |
| 系列： | Virtex® 6 CXT |
| LAB/CLB數： | 10000 |
| 邏輯元件/單元數： | 128000 |
| RAM 位總計： | 9732096 |
| 輸入/輸出數： | 240 |
| 電源電壓： | 0.95 V ~ 1.05 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 484-BBGA，FCBGA |
| 供應商設備封裝： | 484-FCBGA |
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Virtex-6 CXT Family Data Sheet
DS153 (v1.6) February 11, 2011
Product Specification
9
FF1156 Package Placement Diagrams
Figure 7 through Figure 10 show the placement diagrams for the GTX transceivers in the FF1156 package.
X-Ref Target - Figure 7
Figure 7: Placement Diagram for the FF1156 Package
(1 of 4)
CX130T: GTXE1_X0Y15
CX195T: GTXE1_X0Y15
CX240T: GTXE1_X0Y15
CX130T: GTXE1_X0Y14
CX195T: GTXE1_X0Y14
CX240T: GTXE1_X0Y14
CX130T: GTXE1_X0Y13
CX195T: GTXE1_X0Y13
CX240T: GTXE1_X0Y13
CX130T: GTXE1_X0Y12
CX195T: GTXE1_X0Y12
CX240T: GTXE1_X0Y12
QUAD_116
B5
B6
A3
A4
D5
D6
B1
B2
F6
F5
H6
H5
E3
E4
C3
C4
G3
G4
D1
D2
MGTRXP3_116
MGTRXN3_116
MGTTXP3_116
MGTTXN3_116
MGTRXP2_116
MGTRXN2_116
MGTTXP2_116
MGTTXN2_116
MGTREFCLK1P_116
MGTREFCLK1N_116
MGTREFCLK0P_116
MGTREFCLK0N_116
MGTRXP1_116
MGTRXN1_116
MGTTXP1_116
MGTTXN1_116
MGTRXP0_116
MGTRXN0_116
MGTTXP0_116
MGTTXN0_116
ds153_07_020210
X-Ref Target - Figure 8
Figure 8: Placement Diagram for the FF1156 Package
(2 of 4)
CX130T: GTXE1_X0Y11
CX195T: GTXE1_X0Y11
CX240T: GTXE1_X0Y11
CX130T: GTXE1_X0Y10
CX195T: GTXE1_X0Y10
CX240T: GTXE1_X0Y10
QUAD_115
CX130T: GTXE1_X0Y9
CX195T: GTXE1_X0Y9
CX240T: GTXE1_X0Y9
CX130T: GTXE1_X0Y8
CX195T: GTXE1_X0Y8
CX240T: GTXE1_X0Y8
J3
J4
F1
F2
K5
K6
H1
H2
M6
M5
P6
P5
L3
L4
K1
K2
N3
N4
M1
M2
MGTRXP3_115
MGTRXN3_115
MGTTXP3_115
MGTTXN3_115
MGTRXP2_115
MGTRXN2_115
MGTTXP2_115
MGTTXN2_115
MGTREFCLK1P_115
MGTREFCLK1N_115
MGTREFCLK0P_115
MGTREFCLK0N_115
MGTRXP1_115
MGTRXN1_115
MGTTXP1_115
MGTTXN1_115
MGTRXP0_115
MGTRXN0_115
MGTTXP0_115
MGTTXN0_115
ds153_08_020210
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