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參數(shù)資料
| 型號： | XC7K420T-1LFFG901E |
| 廠商： | XILINX INC |
| 元件分類： | FPGA |
| 英文描述： | FPGA, PBGA900 |
| 封裝： | LEAD FREE, FBGA-900 |
| 文件頁數(shù)： | 25/50頁 |
| 文件大小： | 1218K |
| 代理商： | XC7K420T-1LFFG901E |
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Kintex-7 FPGAs Data Sheet: DC and Switching Characteristics
DS182 (v1.1) April 1, 2011
Advance Product Specification
31
CLB Switching Characteristics
Table 35: CLB Switching Characteristics
Symbol
Description
Speed Grade
Units
-3
-2
-1
-1L
Combinatorial Delays
TILO
An – Dn LUT address to A
0.04
0.05
0.07
ns, Max
TILO_2
An – Dn LUT address to AMUX/CMUX
0.16
0.18
0.22
ns, Max
TILO_3
An – Dn LUT address to BMUX_A
0.26
0.30
0.35
ns, Max
TITO
An – Dn inputs to A – D Q outputs
0.64
0.74
0.87
ns, Max
TAXA
AX inputs to AMUX output
0.34
0.40
0.48
ns, Max
TAXB
AX inputs to BMUX output
0.35
0.42
0.50
ns, Max
TAXC
AX inputs to CMUX output
0.39
0.44
0.52
ns, Max
TAXD
AX inputs to DMUX output
0.43
0.48
0.56
ns, Max
TBXB
BX inputs to BMUX output
0.29
0.36
0.44
ns, Max
TBXD
BX inputs to DMUX output
0.34
0.41
0.49
ns, Max
TCXC
CX inputs to CMUX output
0.25
0.29
0.34
ns, Max
TCXD
CX inputs to DMUX output
0.30
0.35
0.40
ns, Max
TDXD
DX inputs to DMUX output
0.32
0.36
0.40
ns, Max
TOPCYA
An input to COUT output
0.29
0.35
0.41
ns, Max
TOPCYB
Bn input to COUT output
0.29
0.35
0.42
ns, Max
TOPCYC
Cn input to COUT output
0.23
0.26
0.30
ns, Max
TOPCYD
Dn input to COUT output
0.22
0.26
0.30
ns, Max
TAXCY
AX input to COUT output
0.26
0.30
0.34
ns, Max
TBXCY
BX input to COUT output
0.20
0.23
0.26
ns, Max
TCXCY
CX input to COUT output
0.15
0.17
0.19
ns, Max
TDXCY
DX input to COUT output
0.14
0.16
0.19
ns, Max
TBYP
CIN input to COUT output
0.06
0.07
ns, Max
TCINA
CIN input to AMUX output
0.22
0.26
0.31
ns, Max
TCINB
CIN input to BMUX output
0.24
0.28
0.33
ns, Max
TCINC
CIN input to CMUX output
0.22
0.25
0.30
ns, Max
TCIND
CIN input to DMUX output
0.26
0.29
0.34
ns, Max
Sequential Delays
TCKO
Clock to AQ – DQ outputs
0.26
0.30
0.35
ns, Max
TSHCKO
Clock to AMUX – DMUX outputs
0.32
0.36
0.43
ns, Max
Setup and Hold Times of CLB Flip-Flops Before/After Clock CLK
TDICK/TCKDI
A – D input to CLK on A – D Flip Flops
0.33/
0.14
0.38/
0.17
0.44/
0.20
ns, Min
TCECK_CLB/
TCKCE_CLB
CE input to CLK on A – D Flip Flops
0.21/
0.01
0.27/
0.01
0.35/
0.01
ns, Min
TSRCK/TCKSR
SR input to CLK on A – D Flip Flops
0.41/
–0.06
0.46/
–0.06
0.55/
–0.06
ns, Min
TCINCK/TCKCIN
CIN input to CLK on A – D Flip Flops
0.15/
0.12
0.17/
0.14
0.20/
0.16
ns, Min
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XC7K420T-1LFFG901I | FPGA, PBGA900 |
| XC7K420T-2FFG1156C | FPGA, PBGA1156 |
| XC7K420T-2FFG1156E | FPGA, PBGA1156 |
| XC7K420T-2FFG1156I | FPGA, PBGA1156 |
| XC7K420T-2FFG901C | FPGA, PBGA900 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| XC7K420T-2FF1156I | 制造商:Xilinx 功能描述:KINTEX-7 - Trays 制造商:Xilinx 功能描述:IC FPGA 400 I/O 1156FCBGA |
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| XC7K420T-2FF901I | 制造商:Xilinx 功能描述:KINTEX-7 - Trays 制造商:Xilinx 功能描述:IC FPGA 380 I/O 901FCBGA |
| XC7K420T-2FFG1156C | 制造商:Xilinx 功能描述:IC FPGA 420K KINTEX-7 1156FBGA |
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