參數(shù)資料
型號: XC9536XV-7CS48C
廠商: Xilinx Inc
文件頁數(shù): 3/9頁
文件大小: 0K
描述: IC CPLD 2.5V ISP 48-CSP
產(chǎn)品變化通告: XC4000XL/E, XC9500XV, XC3100A Discontinuance 12/Apr/2010
標(biāo)準(zhǔn)包裝: 416
系列: XC9500XV
可編程類型: 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1): 7.5ns
電壓電源 - 內(nèi)部: 2.37 V ~ 2.62 V
邏輯元件/邏輯塊數(shù)目: 2
宏單元數(shù): 36
門數(shù): 800
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 48-FBGA,CSPBGA
供應(yīng)商設(shè)備封裝: 48-CSBGA(7x7)
包裝: 托盤
XC9536XV High-performance CPLD
DS053 (v3.0) June 25, 2007
3
Product Specification
R
Supported I/O Standards
The XC9536XV CPLD features both LVCMOS and LVTTL
I/O implementations. See Table 1 for I/O standard voltages.
The LVTTL I/O standard is a general purpose EIA/JEDEC
standard for 3.3V applications that use an LVTTL input
buffer and Push-Pull output buffer. The LVCMOS2 standard
is used in 2.5V applications.
XC9500XV CPLDs are also 1.8V I/O compatible. The
X25TO18 setting is provided for generating 1.8V compatible
outputs from a CPLD normally operating in a 2.5V environ-
ment. The default I/O Standard for pads without IOSTAN-
DARD attributes is LVTTL for XC9500XV devices.
Table 1: IOSTANDARD Options
IOSTANDARD
VCCIO
LVTTL
3.3V
LVCMOS2
2.5V
X25TO18
1.8V
Product Obsolete/Under Obsolescence
相關(guān)PDF資料
PDF描述
VI-2TZ-CX-F3 CONVERTER MOD DC/DC 2V 30W
VE-20R-CY-F4 CONVERTER MOD DC/DC 7.5V 50W
R05P23.3S/X2/R8 CONV DC/DC 2W 05VIN 3.3VOUT
REC3-1205DR/H1/SMD CONV DC/DC 3W 12VIN +/-05VOUT
180-M62-203L021 CONN DB62 FMAL HD SLD CUP NICKEL
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
XC9536XV-7CS48I 制造商:Xilinx 功能描述:
XC9536XV-7PC44C 功能描述:IC CPLD 2.5V ISP 44-PLCC RoHS:否 類別:集成電路 (IC) >> 嵌入式 - CPLD(復(fù)雜可編程邏輯器件) 系列:XC9500XV 標(biāo)準(zhǔn)包裝:24 系列:CoolRunner II 可編程類型:系統(tǒng)內(nèi)可編程 最大延遲時(shí)間 tpd(1):7.1ns 電壓電源 - 內(nèi)部:1.7 V ~ 1.9 V 邏輯元件/邏輯塊數(shù)目:24 宏單元數(shù):384 門數(shù):9000 輸入/輸出數(shù):173 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:208-BFQFP 供應(yīng)商設(shè)備封裝:208-PQFP(28x28) 包裝:托盤
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