參數(shù)資料
型號： XCV1000E-7HQ240C
廠商： Xilinx Inc
文件頁數(shù)： 211/233頁
文件大小： 0K
描述： IC FPGA 1.8V C-TEMP 240-HQFP
產(chǎn)品變化通告： XC1700 PROMs,XC5200,HQ,SCD Parts Discontinuation 19/Jul/2010
標準包裝： 1
系列： Virtex®-E
LAB/CLB數(shù)： 6144
邏輯元件/單元數(shù)： 27648
RAM 位總計： 393216
輸入/輸出數(shù)： 158
門數(shù)： 1569178
電源電壓： 1.71 V ~ 1.89 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 240-BFQFP 裸露焊盤
供應(yīng)商設(shè)備封裝： 240-PQFP（32x32）
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
DS022-3 (v3.0) March 21, 2014
Module 3 of 4
Production Product Specification
19
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
Global Clock Input to Output Delay for LVTTL, 12 mA, Fast Slew Rate, without DLL
Description(1)
Symbol
Device
Speed Grade(2)
Units
Min
-8
-7
-6
LVTTL Global Clock Input to Output Delay using
Output Flip-flop, 12 mA, Fast Slew Rate, without
DLL. For data output with different standards,
adjust the delays with the values shown in IOB
TICKOF
XCV50E
1.5
4.2
4.4
4.6
ns
XCV100E
1.5
4.2
4.4
4.6
ns
XCV200E
1.5
4.3
4.5
4.7
ns
XCV300E
1.5
4.3
4.5
4.7
ns
XCV400E
1.5
4.4
4.6
4.8
ns
XCV600E
1.6
4.5
4.7
4.9
ns
XCV1000E
1.7
4.6
4.8
5.0
ns
XCV1600E
1.8
4.7
4.9
5.1
ns
XCV2000E
1.8
4.8
5.0
5.2
ns
XCV2600E
2.0
5.0
5.2
5.4
ns
XCV3200E
2.2
5.2
5.4
5.6
ns
Notes:
1.
Listed above are representative values where one global clock input drives one vertical clock line in each accessible column, and
where all accessible IOB and CLB flip-flops are clocked by the global clock net.
2.
Output timing is measured at 50% VCC threshold with 35 pF external capacitive load. For other I/O standards and different loads, see
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PDF描述
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XCV1000E-8BG240C 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex⑩-E 1.8 V Field Programmable Gate Arrays
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XCV1000E-8BG560C-0314 制造商:Xilinx 功能描述:
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