參數(shù)資料
型號： XCV200E-8CS144C
廠商： Xilinx Inc
文件頁數(shù)： 204/233頁
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描述： IC FPGA 1.8V C-TEMP 144-CSBGA
產品變化通告： FPGA Family Discontinuation 18/Apr/2011
標準包裝： 198
系列： Virtex®-E
LAB/CLB數(shù)： 1176
邏輯元件/單元數(shù)： 5292
RAM 位總計： 114688
輸入/輸出數(shù)： 94
門數(shù)： 306393
電源電壓： 1.71 V ~ 1.89 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 144-TFBGA，CSPBGA
供應商設備封裝： 144-LCSBGA（12x12）
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
Module 3 of 4
DS022-3 (v3.0) March 21, 2014
12
Production Product Specification
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
Clock Distribution Switching Characteristics
I/O Standard Global Clock Input Adjustments
Speed Grade
Units
Description
Symbol
Min
-8
-7
-6
GCLK IOB and Buffer
Global Clock PAD to output.
TGPIO
0.38
0.7
ns, max
Global Clock Buffer I input to O output
TGIO
0.11
0.20
0.45
0.50
ns, max
Description
Symbol(1)
Standard
Speed Grade
Units
Min
-8
-7
-6
Data Input Delay Adjustments
Standard-specific global clock
input delay adjustments
TGPLVTTL
LVTTL
0.0
ns, max
TGPLVCMOS2
LVCMOS2
–0.02
0.0
ns, max
TGPLVCMOS18
LVCMOS18
0.12
0.20
ns, max
TGLVDS
LVDS
0.23
0.38
ns, max
TGLVPECL
LVPECL
0.23
0.38
ns, max
TGPPCI33_3
PCI, 33 MHz, 3.3 V
–0.05
0.08
ns, max
TGPPCI66_3
PCI, 66 MHz, 3.3 V
–0.05
–0.11
ns, max
TGPGTL
GTL
0.20
0.37
ns, max
TGPGTLP
GTL+
0.20
0.37
ns, max
TGPHSTL
HSTL
0.18
0.27
ns, max
TGPSSTL2
SSTL2
0.21
0.27
ns, max
TGPSSTL3
SSTL3
0.18
0.27
ns, max
TGPCTT
CTT
0.22
0.33
ns, max
TGPAGP
AGP
0.21
0.27
ns, max
Notes:
1.
Input timing for GPLVTTL is measured at 1.4 V. For other I/O standards, see Table 4.
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XCV200E-8FG256I 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-E 1.8 V Field Programmable Gate Arrays
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