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參數(shù)資料
| 型號： | XCV300E-6BG432I |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 149/233頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 1.8V I-TEMP 432-MBGA |
| 產(chǎn)品變化通告： | FPGA Family Discontinuation 18/Apr/2011 |
| 標準包裝： | 21 |
| 系列： | Virtex®-E |
| LAB/CLB數(shù)： | 1536 |
| 邏輯元件/單元數(shù)： | 6912 |
| RAM 位總計： | 131072 |
| 輸入/輸出數(shù)： | 316 |
| 門數(shù)： | 411955 |
| 電源電壓： | 1.71 V ~ 1.89 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 432-LBGA，金屬 |
| 供應(yīng)商設(shè)備封裝： | 432-MBGA（40x40） |
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
Module 4 of 4
DS022-4 (v3.0) March 21, 2014
146
Production Product Specification
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
Revision History
The following table shows the revision history for this document.
Date
Version
Revision
12/07/1999
1.0
Initial Xilinx release.
01/10/2000
1.1
Re-released with spd.txt v. 1.18, FG860/900/1156 package information, and additional DLL,
Select RAM and SelectI/O information.
01/28/2000
1.2
Added Delay Measurement Methodology table, updated SelectI/O section, Figures 30, 54,
& 55, text explaining Table 5, TBYP values, buffered Hex Line info, p. 8, I/O Timing
Measurement notes, notes for Tables 15, 16, and corrected F1156 pinout table footnote
references.
02/29/2000
1.3
Updated pinout tables, VCC page 20, and corrected Figure 20.
05/23/2000
1.4
Correction to table on p. 22.
07/10/2000
1.5
Numerous minor edits.
Data sheet upgraded to Preliminary.
Preview -8 numbers added to Virtex-E Electrical Characteristics tables.
08/01/2000
1.6
Reformatted entire document to follow new style guidelines.
Changed speed grade values in tables on pages 35-37.
09/20/2000
1.7
Min values added to Virtex-E Electrical Characteristics tables.
XCV2600E and XCV3200E numbers added to Virtex-E Electrical Characteristics
tables (Module 3).
Corrected user I/O count for XCV100E device in Table 1 (Module 1).
Changed several pins to “No Connect in the XCV100E“ and removed duplicate VCCINT
pins in Table ~ (Module 4).
Changed pin J10 to “No connect in XCV600E” in Table 74 (Module 4).
Changed pin J30 to “VREF or I/O option only in the XCV600E” in Table 74 (Module 4).
Corrected pair 18 in Table 75 (Module 4) to be “AO in the XCV1000E, XCV1600E“.
11/20/2000
1.8
Upgraded speed grade -8 numbers in Virtex-E Electrical Characteristics tables to
Preliminary.
Updated minimums in Table 13 and added notes to Table 14.
Added to note 2 to Absolute Maximum Ratings.
Changed speed grade -8 numbers for TSHCKO32, TREG, TBCCS, and TICKOF.
Changed all minimum hold times to –0.4 under Global Clock Set-Up and Hold for
LVTTL Standard, with DLL.
Revised maximum TDLLPW in -6 speed grade for DLL Timing Parameters.
Changed GCLK0 to BA22 for FG860 package in Table 46.
02/12/2001
1.9
Revised footnote for Table 14.
Added numbers to Virtex-E Electrical Characteristics tables for XCV1000E and
XCV2000E devices.
Updated Table 27 and Table 78 to include values for XCV400E and XCV600E devices.
Revised Table 62 to include pinout information for the XCV400E and XCV600E devices
in the BG560 package.
Updated footnotes 1 and 2 for Table 76 to include XCV2600E and XCV3200E devices.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XC4VLX25-10FF668I | IC FPGA VIRTEX-4LX 668FFBGA |
| 1-745130-3 | CONN FERRULE OUTER CRIMP DB37-50 |
| SST39SF040-55-4I-NHE | IC FLASH MPF 4MBIT 55NS 32PLCC |
| SST39WF1602-70-4I-B3KE | IC FLASH MPF 16MBIT 70NS 48TFBGA |
| SST39WF1602-70-4C-B3KE | IC FLASH MPF 16MBIT 70NS 48TFBGA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XCV300E-6CS144C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Field Programmable Gate Arrays |
| XCV300E-6CS144I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Field Programmable Gate Arrays |
| XCV300E-6FG204C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virte -E 1.8 V Field Programmable Gate Arrays |
| XCV300E-6FG204I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virte -E 1.8 V Field Programmable Gate Arrays |
| XCV300E-6FG240C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex⑩-E 1.8 V Field Programmable Gate Arrays |
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