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參數(shù)資料
| 型號(hào)： | XCV400E-6PQ240C |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 66/233頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA 1.8V C-TEMP 240-PQFP |
| 產(chǎn)品變化通告： | FPGA Family Discontinuation 18/Apr/2011 |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 系列： | Virtex®-E |
| LAB/CLB數(shù)： | 2400 |
| 邏輯元件/單元數(shù)： | 10800 |
| RAM 位總計(jì)： | 163840 |
| 輸入/輸出數(shù)： | 158 |
| 門數(shù)： | 569952 |
| 電源電壓： | 1.71 V ~ 1.89 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 240-BFQFP |
| 供應(yīng)商設(shè)備封裝： | 240-PQFP（32x32） |
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
Module 4 of 4
DS022-4 (v3.0) March 21, 2014
72
Production Product Specification
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
FG680 Fine-Pitch Ball Grid Array Package
XCV600E,
XCV1000E,
XCV1600E,
and
XCV2000E
devices in the FG680 fine-pitch Ball Grid Array package
have footprint compatibility. Pins labeled I0_VREF can be
used as either in all parts unless device-dependent as indi-
cated in the footnotes. If the pin is not used as VREF, it can
be used as general I/O. Immediately following Table 22, see
Table 23 for Differential Pair information.
Table 22: FG680 - XCV600E, XCV1000E, XCV1600E, XCV2000E
Bank
Pin Description
Pin #
0GCK3
A20
0IO
D35
0IO
B36
0
IO_L0N_Y
C35
0
IO_L0P_Y
A36
0
IO_VREF_L1N_Y
D341
0
IO_L1P_Y
B35
0
IO_L2N_YY
C34
0
IO_L2P_YY
A35
0
IO_VREF_L3N_YY
D33
0
IO_L3P_YY
B34
0IO_L4N
C33
0
IO_L4P
A34
0
IO_L5N_Y
D32
0
IO_L5P_Y
B33
0
IO_L6N_YY
C32
0
IO_L6P_YY
D31
0
IO_VREF_L7N_YY
A33
0
IO_L7P_YY
C31
0
IO_L8N_Y
B32
0
IO_L8P_Y
B31
0
IO_VREF_L9N_Y
A323
0IO_L9P_Y
D30
0
IO_L10N_YY
A31
0
IO_L10P_YY
C30
0
IO_VREF_L11N_YY
B30
0
IO_L11P_YY
D29
0
IO_L12N_Y
A30
0
IO_L12P_Y
C29
0
IO_L13N_Y
A29
0
IO_L13P_Y
B29
0
IO_VREF_L14N_YY
B28
0
IO_L14P_YY
A28
0
IO_L15N_YY
C28
0
IO_L15P_YY
B27
0
IO_L16N_Y
D27
0
IO_L16P_Y
A27
0
IO_L17N_Y
C27
0
IO_L17P_Y
B26
0
IO_L18N_YY
D26
0
IO_L18P_YY
C26
0
IO_VREF_L19N_YY
A261
0
IO_L19P_YY
D25
0
IO_L20N_Y
B25
0
IO_L20P_Y
C25
0
IO_L21N_Y
A25
0
IO_L21P_Y
D24
0
IO_L22N_YY
A24
0
IO_L22P_YY
B23
0
IO_VREF_L23N_YY
C24
0
IO_L23P_YY
A23
0
IO_L24N_Y
B24
0
IO_L24P_Y
B22
0
IO_L25N_Y
E23
0
IO_L25P_Y
A22
0
IO_L26N_YY
D23
0
IO_L26P_YY
B21
0
IO_VREF_L27N_YY
C23
0
IO_L27P_YY
A21
0
IO_L28N_Y
E22
0
IO_L28P_Y
B20
0
IO_LVDS_DLL_L29N
C22
0
IO_VREF
D222
1GCK2
D21
Table 22: FG680 - XCV600E, XCV1000E, XCV1600E, XCV2000E
Bank
Pin Description
Pin #
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XC5VLX30T-1FFG323C | IC FPGA VIRTEX-5LX 30K 323-FCBGA |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XCV400E-6PQ240C0773 | 制造商:Rochester Electronics LLC 功能描述: 制造商:Xilinx 功能描述: |
| XCV400E-6PQ240I | 功能描述:IC FPGA 1.8V I-TEMP 240-PQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:Virtex®-E 產(chǎn)品變化通告:Step Intro and Pkg Change 11/March/2008 標(biāo)準(zhǔn)包裝:1 系列:Virtex®-5 SXT LAB/CLB數(shù):4080 邏輯元件/單元數(shù):52224 RAM 位總計(jì):4866048 輸入/輸出數(shù):480 門數(shù):- 電源電壓:0.95 V ~ 1.05 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:1136-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:1136-FCBGA 配用:568-5088-ND - BOARD DEMO DAC1408D750122-1796-ND - EVALUATION PLATFORM VIRTEX-5 |
| XCV400E-6PQG240C | 制造商:Xilinx 功能描述:FPGA VIRTEX-E 129.6K GATES 10800 CELLS 357MHZ 0.18UM 1.8V 24 - Trays |
| XCV400E-7BG240C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex⑩-E 1.8 V Field Programmable Gate Arrays |
| XCV400E-7BG240I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex⑩-E 1.8 V Field Programmable Gate Arrays |
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