參數(shù)資料
型號(hào)： XCV600E-7BG432C
廠商： Xilinx Inc
文件頁(yè)數(shù)： 21/233頁(yè)
文件大?。?/td> 0K
描述： IC FPGA 1.8V C-TEMP 432-MBGA
產(chǎn)品變化通告： FPGA Family Discontinuation 18/Apr/2011
標(biāo)準(zhǔn)包裝： 1
系列： Virtex®-E
LAB/CLB數(shù)： 3456
邏輯元件/單元數(shù)： 15552
RAM 位總計(jì)： 294912
輸入/輸出數(shù)： 316
門數(shù)： 985882
電源電壓： 1.71 V ~ 1.89 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 432-LBGA，金屬
供應(yīng)商設(shè)備封裝： 432-MBGA（40x40）
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
DS022-4 (v3.0) March 21, 2014
Module 4 of 4
Production Product Specification
31
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
BG432 Differential Pin Pairs
Virtex-E devices have differential pin pairs that can also Vir-
tex-E devices have differential pin pairs that can also pro-
vide other functions when not used as a differential pair. A
√
in the AO column indicates that the pin pair can be used as
an asynchronous output for all devices provided in this
package. Pairs with a note number in the AO column are
device dependent. They can have asynchronous outputs if
the pin pair are in the same CLB row and column in the
device. Numbers in this column refer to footnotes that indi-
cate which devices have pin pairs than can be asynchro-
nous outputs. The Other Functions column indicates
alternative function(s) not available when the pair is used as
a differential pair or differential clock.
Table 13: BG432 Differential Pin Pair Summary
XCV300E, XCV400E, XC600E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
Global Differential Clock
0
4
AL16
AH15
NA
IO_DLL_L86P
1
5
AK16
AL17
NA
IO_DLL_L86N
2
1
A16
B16
NA
IO_DLL_L16P
3
0
D17
C17
NA
IO_DLL_L16N
IO LVDS
Total Outputs: 137, Asynchronous Output Pairs: 63
00
D27
B29
1
-
10
C27
B28
√
-
20
A28
D26
√
VREF
30
C26
B27
2
-
40
A27
D25
√
-
50
C25
D24
√
VREF
60
D23
B25
1
-
70
B24
C24
1
VREF
80
A24
D22
√
VREF
90
B22
C22
√
-
10
0
D20
C21
√
-
11
0
C20
B21
√
-
12
0
D19
A20
√
-
13
0
A19
B19
√
VREF
14
0
D18
B18
1
-
15
0
B17
C18
1
VREF
16
1
B16
C17
NA
IO_LVDS_DLL
17
1
B15
A15
1
VREF
18
1
D15
C15
1
-
19
1
A13
B14
√
VREF
20
1
D14
B13
√
-
21
1
B12
C13
√
-
22
1
C12
D13
√
-
23
1
C11
D12
√
-
24
1
C10
B10
√
VREF
25
1
D10
C9
1
VREF
26
1
B8
A8
1
-
27
1
B7
C8
√
VREF
28
1
A6
D8
√
-
29
1
D7
B6
2
-
30
1
C6
A5
√
VREF
31
1
D6
B5
√
-
32
1
C5
A4
1
-
33
1
D5
B4
√
CS, WRITE
34
2
D3
C2
√
DIN, D0, BUSY
35
2
D2
E4
3
-
36
2
D1
E3
4
-
37
2
E2
F4
1
VREF
38
2
E1
F3
5
-
39
2
F2
G4
1
-
40
2
G3
G2
√
VREF
41
2
H3
H2
4
-
42
2
H1
J4
1
VREF
43
2
J2
K4
√
D1
44
2
K2
K1
√
D2
45
2
L2
M4
4
-
46
2
M3M21
-
47
2
N4
N3
1
-
Table 13: BG432 Differential Pin Pair Summary
XCV300E, XCV400E, XC600E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
相關(guān)PDF資料
PDF描述
XCV600E-6FG676I IC FPGA 1.8V I-TEMP 676-FBGA
XCV600E-6BG560I IC FPGA 1.8V I-TEMP 560-MBGA
XCV600E-6BG432I IC FPGA 1.8V I-TEMP 432-MBGA
ASC60DRTN-S13 CONN EDGECARD 120POS .100 EXTEND
ASC60DRTH-S13 CONN EDGECARD 120POS .100 EXTEND
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
XCV600E-7BG432C0773 制造商:Rochester Electronics LLC 功能描述: 制造商:Xilinx 功能描述:
XCV600E-7BG432I 功能描述:IC FPGA 1.8V I-TEMP 432-MBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:Virtex®-E 產(chǎn)品變化通告:Step Intro and Pkg Change 11/March/2008 標(biāo)準(zhǔn)包裝:1 系列:Virtex®-5 SXT LAB/CLB數(shù):4080 邏輯元件/單元數(shù):52224 RAM 位總計(jì):4866048 輸入/輸出數(shù):480 門數(shù):- 電源電壓:0.95 V ~ 1.05 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:1136-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:1136-FCBGA 配用:568-5088-ND - BOARD DEMO DAC1408D750122-1796-ND - EVALUATION PLATFORM VIRTEX-5
XCV600E-7BG560C 功能描述:IC FPGA 1.8V C-TEMP 560-MBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:Virtex®-E 產(chǎn)品變化通告:Step Intro and Pkg Change 11/March/2008 標(biāo)準(zhǔn)包裝:1 系列:Virtex®-5 SXT LAB/CLB數(shù):4080 邏輯元件/單元數(shù):52224 RAM 位總計(jì):4866048 輸入/輸出數(shù):480 門數(shù):- 電源電壓:0.95 V ~ 1.05 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:1136-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:1136-FCBGA 配用:568-5088-ND - BOARD DEMO DAC1408D750122-1796-ND - EVALUATION PLATFORM VIRTEX-5
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XCV600E-7FG240C 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex⑩-E 1.8 V Field Programmable Gate Arrays
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