參數(shù)資料
| 型號： | XRT72L50IQ-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 181/471頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FRAMER DS3/E3 SGL 100QFP |
| 標準包裝： | 66 |
| 控制器類型： | DS3/E3 調幀器 |
| 電源電壓： | 3.3V |
| 電流 - 電源： | 120mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-BQFP |
| 供應商設備封裝： | 100-QFP（14x20） |
| 包裝： | 托盤 |
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á
XRT72L50
SINGLE CHANNEL DS3/E3 FRAMER WITH HDLC CONTROLLER
REV. 1.2.1
248
The XRT72L50 Framer will latch the data residing on the TxSer input line on the rising edge of the TxInClk
signal.
In this case, the Terminal Equipment has the responsibility of providing the framing reference signal by pulsing
its Tx_Start_of_Frame output signal (and in turn, the TxFrameRef input pin of the XRT72L50), "High" for one-
bit period, coincident with the first bit of a new E3 frame. Once the XRT72L50 detects the rising edge of the
input at its TxFrameRef input pin, it will begin generation of a new E3 frame.
NOTES:
1.
In this case, the Terminal Equipment is controlling the start of Frame Generation, and is therefore referred to as
the Frame Master. Conversely, since the XRT72L50 does not control the generation of a new E3 frame, but is
rather driven by the Terminal Equipment, the XRT72L50 is referred to as the Frame Slave.
2.
If the user opts to configure the XRT72L50 to operate in Mode 2, it is imperative that the Tx_Start_of_Frame (or
TxFrameRef) signal is synchronized to the TxInClk input clock signal.
Finally, the XRT72L50 will pulse its TxOH_Ind output pin, one bit-period prior to it processing a given overhead
bit, within the outbound E3 frame. Since the TxOH_Ind output pin of the XRT72L50 is electrically connected to
the E3_Overhead_Ind whenever the XRT72L50 pulses the TxOH_Ind output pin "High", it will also be driving
the E3_Overhead_Ind input pin (of the Terminal Equipment) "High".
Whenever the Terminal Equipment
detects this pin toggling "High", it should delay transmission of the very next E3 frame payload bit by one clock
cycle.
The behavior of the signals between the XRT72L50 and the Terminal Equipment for E3 Mode 2 Operation is
illustrated in Figure 91.
How to configure the XRT72L50 to operate in this mode.
1. Set the NibIntf input pin "Low".
2. Set the TimRefSel[1:0] bit-fields (within the Framer Operating Mode Register) to "01" as depicted below.
FIGURE 91. BEHAVIOR OF THE TERMINAL INTERFACE SIGNALS BETWEEN THE XRT72L50 AND THE TERMINAL
EQUIPMENT (MODE 2 OPERATION)
Terminal Equipment Signals
E3_Clock_In
E3_Data_Out
Tx_Start_of_Frame
E3_Overhead_Ind
XRT72L5x Transmit Payload Data I/F Signals
TxInClk
TxSer
TxFrameRef
TxOH_Ind
Payload[1522]
Payload[1523]
FAS, Bit 9
FAS, Bit 8
Payload[1522]
Payload[1523]
FAS, Bit 9
FAS, Bit 8
Note: FAS Pattern bits will not be processed by the
Transmit Payload Data Input Interface.
E3 Frame Number N
E3 Frame Number N + 1
Note: TxFrame pulses high to denote
E3 Frame Boundary.
Note: TxOH_Ind pulses high for
12 bit periods in order to
denote Overhead Data
(e.g., the FAS pattern
and the A & N bits).
相關PDF資料 |
PDF描述 |
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