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參數(shù)資料
| 型號： | XRT86VL38IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 158/160頁 |
| 文件大小： | 0K |
| 描述： | IC LIU/FRAMER T1/E1/J1 8CH 420BG |
| 標(biāo)準(zhǔn)包裝： | 40 |
| 控制器類型： | T1/E1/J1 調(diào)幀器，LIU |
| 電源電壓： | 3.3V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 420-BBGA |
| 供應(yīng)商設(shè)備封裝： | 420-PBGA |
| 包裝： | 托盤 |
| 其它名稱： | 1016-1487 XRT86VL38IB-F-ND |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁當(dāng)前第158頁第159頁第160頁
XRT86VL38
92
REV. V1.2.0
OCTAL T1/E1/J1 FRAMER/LIU COMBO - T1 REGISTER DESCRIPTION
2
SLIP
RO
0
Slip Buffer Block Interrupt Status
This bit indicates whether or not the Slip Buffer block has any out-
standing interrupt request awaiting service.
0 = Indicates no outstanding Slip Buffer Block interrupt request is
awaiting service
1 = Indicates Slip Buffer block has an interrupt request awaiting ser-
vice. Interrupt Service routine should branch to the interrupt source
and read the Slip Buffer Interrupt Status register (address 0xnB08)
to clear the interrupt
NOTE:
This bit will be reset to 0 after the microprocessor has
performed a read to the Slip Buffer Interrupt Status
Register.
1
ALARM
RO
0
Alarm & Error Block Interrupt Status
This bit indicates whether or not the Alarm & Error Block has any
outstanding interrupt request awaiting service.
0 = Indicates no outstanding interrupt request is awaiting service
1 = Indicates the Alarm & Error Block has an interrupt request await-
ing service. Interrupt service routine should branch to the interrupt
source and read the corresponding alarm and error status registers
(address 0xnB02, 0xnB0E, 0xnB40) to clear the interrupt.
NOTE:
This bit will be reset to 0 after the microprocessor has
performed a read to the corresponding Alarm & Error
Interrupt Status register that generated the interrupt.
0
T1 FRAME
RO
0
T1 Framer Block Interrupt Status
This bit indicates whether or not the T1 Framer block has any out-
standing interrupt request awaiting service.
0 = Indicates no outstanding interrupt request is awaiting service.
1 = Indicates the T1 Framer Block has an interrupt request awaiting
service. Interrupt service routine should branch to the interrupt
source and read the T1 Framer status register (address 0xnB04) to
clear the interrupt
NOTE:
This bit will be reset to 0 after the microprocessor has
performed a read to the T1 Framer Interrupt Status register.
TABLE 80: BLOCK INTERRUPT STATUS REGISTER (BISR)
HEX ADDRESS: 0XnB00
BIT
FUNCTION
TYPE
DEFAULT
DESCRIPTION-OPERATION
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