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參數(shù)資料
| 型號： | μPD70P083 |
| 廠商： | NEC Corp. |
| 英文描述： | 8 Bit Single Chip Microcontrollers(8位單片微控制器) |
| 中文描述： | 8位單片機微控制器（8位單片微控制器） |
| 文件頁數(shù)： | 32/56頁 |
| 文件大?。?/td> | 390K |
| 代理商： | ΜPD70P083 |
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32
m
PD78P083
(2)
Serial Interface
(T
A
= –40 to +85°C, V
DD
= 1.8 to 5.5 V)
(a)
3-wire serial I/O mode (SCK2 ··· internal clock output)
Note
C is the SCK2, SO2 output line load capacitance.
(b)
3-wire serial I/O mode (SCK2 ··· external clock input)
Parameter
Symbol
Test Conditions
MIN.
TYP.
MAX.
Unit
SCK2 cycle time
t
KCY1
4.5 V - V
DD
- 5.5 V
800
ns
2.7 V - V
DD
< 4.5 V
1600
ns
2.0 V - V
DD
< 2.7 V
3200
ns
4800
ns
SCK2 high-/low-level width
t
KH1
,
V
DD
= 4.5 to 5.5 V
t
KCY1
/2–50
ns
t
KL1
t
KCY1
/2–100
ns
SI2 setup time
(to SCK2
)
t
SIK1
4.5 V - V
DD
- 5.5 V
100
ns
2.7 V - V
DD
< 4.5 V
150
ns
2.0 V - V
DD
< 2.7 V
300
ns
400
ns
SI2 hold time
(from SCK2
)
SCK2
SO2
output delay time
t
KSI1
400
ns
t
KSO1
C = 100 pF
Note
300
ns
Parameter
Symbol
Test Conditions
MIN.
TYP.
MAX.
Unit
SCK2 cycle time
t
KCY2
4.5 V - V
DD
- 5.5 V
800
ns
2.7 V - V
DD
< 4.5 V
1600
ns
2.0 V - V
DD
< 2.7 V
3200
ns
4800
ns
SCK2 high-/low-level width
t
KH2
,
4.5 V - V
DD
- 5.5 V
400
ns
t
KL2
2.7 V - V
DD
< 4.5 V
800
ns
2.0 V - V
DD
< 2.7 V
1600
ns
2400
ns
SI2 setup time
(to SCK2
)
SI2 hold time
(from SCK2
)
SCK2
SO2
output delay time
t
SIK2
V
DD
= 2.0 to 5.5 V
100
ns
150
ns
t
KSI2
400
ns
t
KSO2
C = 100 pF
Note
V
DD
= 2.0 to 5.5 V
300
ns
500
ns
SCK2 rise, fall time
t
R2
,
1000
ns
t
F2
Note
C is the SO2 output line load capacitance.
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