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參數(shù)資料
| 型號： | μPD78P078Y |
| 廠商： | NEC Corp. |
| 英文描述： | 8 Bit Single Chip Microcontrollers(8位單片微控制器) |
| 中文描述： | 8位單片機(jī)微控制器（8位單片微控制器） |
| 文件頁數(shù)： | 44/84頁 |
| 文件大?。?/td> | 472K |
| 代理商： | ΜPD78P078Y |
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44
m
PD78P078Y
Parameter
Symbol
Test Conditions
MIN.
MAX.
Unit
ASTB high-level width
t
ASTH
t
CY
– 80
ns
Address setup time
t
ADS
t
CY
– 80
ns
Address hold time
Address
Data input time
t
ADH
0.4t
CY
– 10
ns
t
ADD1
(3 + 2n) t
CY
– 160
ns
t
ADD2
(4 + 2n) t
CY
– 200
ns
RD
Data input time
t
RDD1
(1.4 + 2n) t
CY
– 70
ns
t
RDD2
(2.4 + 2n) t
CY
– 70
ns
Read data hold time
t
RDH
0
ns
RD low-level width
t
RDL1
(1.4 + 2n) t
CY
– 20
ns
t
RDL2
(2.4 + 2n) t
CY
– 20
ns
RD
WAIT
input time
t
RDWT1
t
CY
– 100
ns
t
RDWT2
2t
CY
– 100
ns
WR
WAIT
input time
WAIT low-level width
t
WRWT
2t
CY
– 100
ns
t
WTL
(1 + 2n) t
CY
(2 + 2n) t
CY
ns
Write data setup time
t
WDS
(2.4 + 2n) t
CY
– 60
ns
Write data hold time
t
WDH
load resistance 5 k
y
20
ns
WR low-level width
ASTB
RD
delay time
ASTB
WR
delay time
In external fetch RD
ASTB
delay time
In external fetch RD
address hold time
RD
write data output time
WR
write data output time
WR
address hold time
WAIT
RD
delay time
WAIT
WR
delay time
t
WRL
(2.4 + 2n) t
CY
– 20
ns
t
ASTRD
0.4t
CY
– 30
ns
t
ASTWR
1.4t
CY
– 30
ns
t
RDAST
t
CY
– 10
t
CY
+ 20
ns
t
RDADH
t
CY
– 80
t
CY
+ 50
ns
t
RDWD
0.4t
CY
– 30
ns
t
WRWD
0
60
ns
t
WRADH
t
CY
– 60
t
CY
+ 60
ns
t
WTRD
0.6t
CY
+ 180
2.6t
CY
+ 180
ns
t
WTWR
0.6t
CY
+ 120
2.6t
CY
+ 120
ns
(b) Except When MCS = 1, PCC2 to PCC0 = 000B
(T
A
= –40 to +85°C, V
DD
= 2.7 to 5.5 V)
Remarks
1.
2.
3.
4.
MCS: Bit 0 of the oscillation mode selection register (OSMS)
PCC2 to PCC0: Bit 2 to bit 0 of the processor clock control register (PCC)
t
CY
= T
CY
/4
n indicates the number of waits.
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PDF描述 |
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