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參數(shù)資料
型號(hào)： 5CEFA7U19C8NES
廠商： Altera
文件頁(yè)數(shù)： 259/1077頁(yè)
文件大?。?/td> 0K
描述： IC CYCLONE V FPGA 150K 484-UBGA
標(biāo)準(zhǔn)包裝： 84
系列： Cyclone® V E
LAB/CLB數(shù)： 56415
邏輯元件/單元數(shù)： 149500
RAM 位總計(jì)： 6656000
輸入/輸出數(shù)： 240
電源電壓： 1.07 V ~ 1.13 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 484-FBGA
供應(yīng)商設(shè)備封裝： 484-UBGA（19x19）
其它名稱： 544-2737
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comes last. Therefore, you can start retrieving the contents of the EMR at the rising edge of the CRC_ERROR
pin. The pin stays high until the current frame is read and then driven low again for a minimum of 32 clock
cycles. To ensure information integrity, complete the read operation within one frame of the CRC verification.
The following diagram shows the timing of these events.
Figure 8-5: Timing Requirements
No CRC Error
CRC Error
No CRC Error
N
N+1
N+2
N+3
N+4
N+5
Frame
Data Integrity
Read Data Frame
CRC ERROR Pin
CRC Calculation
(minimum 32 clock
cycles)
Read Error Message
Register (allowed time)
Read Error Message
for frame N+1
Read Error Message
for frame N+2
Read Error Message
for frame N+4
Retrieving Error Information
You can retrieve the error information via the core interface or the JTAG interface using the
SHIFT_EDERROR_REG JTAG
instruction.
Recovering from CRC Errors
The system that hosts the FPGA must control device reconfiguration. To recover from a CRC error, drive
the nCONFIG signal low. The system waits for a safe time before reconfiguring the device. When reconfiguration
completes successfully, the FPGA operates as intended.
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Testing the Error Detection Block
You can inject errors into the configuration data to test the error detection block. This error injection
methodology provides design verification and system fault tolerance characterization.
Testing via the JTAG Interface
You can intentionally inject single or double-adjacent errors into the configuration data using the
EDERROR_INJECT
JTAG instruction.
SEU Mitigation for Cyclone V Devices
Altera Corporation
CV-52008
Testing the Error Detection Block
8-8
2013.11.12
相關(guān)PDF資料
PDF描述
GCB80DHBR CONN EDGECARD 160PS R/A .050 SLD
M1AFS1500-1FG256 IC FPGA 8MB FLASH 1.5M 256-FBGA
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AFS1500-1FGG256 IC FPGA 8MB FLASH 1.5M 256-FBGA
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參數(shù)描述
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5CEFA7U19I7N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Cyclone V E 5648 LABs 240 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
5CEFA9F23C7N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Cyclone V E 11356 LABs 224 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
5CEFA9F23C8N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Cyclone V E 11356 LABs 224 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
5CEFA9F23I7N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Cyclone V E 11356 LABs 224 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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