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參數(shù)資料
| 型號： | 73S1209F-44IM/F |
| 廠商： | TERIDIAN SEMICONDUCTOR CORP |
| 元件分類： | 電源管理 |
| 英文描述： | POWER SUPPLY MANAGEMENT CKT, QCC44 |
| 封裝： | LEAD FREE, QFN-44 |
| 文件頁數(shù)： | 117/123頁 |
| 文件大?。?/td> | 1385K |
| 代理商： | 73S1209F-44IM/F |
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DS_1209F_004
73S1209F Data Sheet
Rev. 1.2
93
Parity Control Register (SParCtl): 0xFE11
0x00
This register provides the ability to configure the parity circuitry on the smart card interface. The settings
apply to both integrated smart card interfaces.
Table 89: The SParCtl Register
MSB
LSB
–
DISPAR BRKGEN BRKDET RETRAN DISCRX
INSPE
FORCPE
Bit
Symbol
Function
SParCtl.7
–
SParCtl.6
DISPAR
Disable Parity Check – 1 = disabled, 0 = enabled. If enabled, the UART
will check for even parity (the number of 1’s including the parity bit is even)
on every character. This also applies to the TS during ATR.
SParCtl.5
BRKGEN
Break Generation Disable – 1 = disabled, 0 = enabled. If enabled, and T=0
protocol, the UART will generate a Break to the smart card if a parity error
is detected on a receive character. No Break will be generated if parity
checking is disabled. This also applies to TS during ATR.
SParCtl.4
BRKDET
Break Detection Disable – 1 = disabled, 0 = enabled. If enabled, and T=0
protocol, the UART will detect the generation of a Break by the smart card.
SParCtl.3
RETRAN
Retransmit Byte – 1 = enabled, 0 = disabled. If enabled and a Break is
detected from the smart card (Break Detection must be enabled), the last
character will be transmitted again. This bit applies to T=0 protocol.
SParCtl.2
DISCRX
Discard Received Byte – 1 = enabled, 0 = disabled. If enabled and a parity
error is detected (Parity checking must be enabled), the last character
received will be discarded. This bit applies to T=0 protocol.
SParCtl.1
INSPE
Insert Parity Error – 1 = enabled, 0 = disabled. Used for test purposes. If
enabled, the UART will insert a parity error in every character transmitted
by generating odd parity instead of even parity for the character.
SParCtl.0
FORCPE
Force Parity Error – 1 = enabled, 0 = disabled. Used for test purposes. If
enabled, the UART will generate a parity error on a character received from
the smart card.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 73S1210F-44IMR/F | 1-CHANNEL POWER SUPPLY MANAGEMENT CKT, QCC44 |
| 73S1210F-68IM/F/P | 1-CHANNEL POWER SUPPLY MANAGEMENT CKT, QCC68 |
| 73S1210F-44IMR/F/P | 1-CHANNEL POWER SUPPLY MANAGEMENT CKT, QCC44 |
| 73S1210F-68IMR/F/P | 1-CHANNEL POWER SUPPLY MANAGEMENT CKT, QCC68 |
| 73S1210F-68IM/F | 1-CHANNEL POWER SUPPLY MANAGEMENT CKT, QCC68 |
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參數(shù)描述 |
|---|---|
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| 73S1209F-44M/F/PD | 功能描述:8位微控制器 -MCU RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
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