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參數(shù)資料
| 型號： | 74ACT573TTR |
| 廠商： | 意法半導體 |
| 元件分類： | 通用總線功能 |
| 英文描述： | OCTAL D-TYPE LATCH WITH 3 STATE OUTPUTS (NON INVERTED) |
| 中文描述： | 八路D型帶三態(tài)輸出（非反相鎖存） |
| 文件頁數(shù)： | 4/11頁 |
| 文件大?。?/td> | 244K |
| 代理商： | 74ACT573TTR |
74ACT573
4/11
DC SPECIFICATIONS
1) Maximum test duration 2ms, one output loaded at time
2) Incident wave switching is guaranteed on transmission lines with impedances as low as 50
AC ELECTRICAL CHARACTERISTICS
(C
L
= 50 pF, R
L
= 500
, Input t
r
= t
f
= 3ns)
(*) Voltage range is 5.0V
±
0.5V
Symbol
Parameter
Test Condition
Value
Unit
V
CC
(V)
T
A
= 25°C
-40 to 85°C
-55 to 125°C
Min.
Typ.
Max.
Min.
Max.
Min.
Max.
V
IH
High Level Input
Voltage
4.5
5.5
4.5
5.5
4.5
5.5
4.5
5.5
4.5
5.5
4.5
5.5
V
O
= 0.1 V or
V
CC
-0.1V
V
O
= 0.1 V or
V
CC
-0.1V
I
O
=-50
μ
A
I
O
=-50
μ
A
I
O
=-24 mA
I
O
=-24 mA
I
O
=50
μ
A
I
O
=50
μ
A
I
O
=24 mA
I
O
=24 mA
2.0
2.0
1.5
1.5
1.5
1.5
4.49
5.49
2.0
2.0
2.0
2.0
V
V
IL
Low Level Input
Voltage
0.8
0.8
0.8
0.8
0.8
0.8
V
V
OH
High Level Output
Voltage
4.4
5.4
3.86
4.86
4.4
5.4
3.76
4.76
4.4
5.4
3.7
4.7
V
V
OL
Low Level Output
Voltage
0.001
0.001
0.1
0.1
0.36
0.36
0.1
0.1
0.44
0.44
0.1
0.1
0.5
0.5
I
I
Input Leakage Cur-
rent
High Impedance
Output Leakege
Current
Max I
CC
/Input
Quiescent Supply
Current
5.5
V
I
= V
CC
or GND
±
0.1
±
1
±
1
μ
A
I
OZ
5.5
V
I
= V
IH
or V
IL
V
O
= V
CC
or GND
±
0.5
±
5
±
5
μ
A
I
CCT
I
CC
5.5
V
I
= V
CC
- 2.1V
0.6
1.5
1.6
mA
5.5
V
I
= V
CC
or GND
4
40
80
μ
A
I
OLD
I
OHD
Dynamic Output
Current (note 1, 2)
5.5
V
OLD
= 1.65 V max
V
OHD
= 3.85 V min
75
-75
50
-50
mA
mA
Symbol
Parameter
Test Condition
Value
Unit
V
CC
(V)
T
A
= 25°C
-40 to 85°C
-55 to 125°C
Min.
Typ.
Max.
Min.
Max.
Min.
Max.
t
PLH
t
PHL
Propagation Delay
Time LE to Q
t
PLH
t
PHL
Propagation Delay
Time D to Q
t
PZL
t
PZH
Output Enable
Time
t
PLZ
t
PHZ
Output Disable
Time
t
W
Minimum Pulse
Width HIGH LE
t
s
Setup Time D to
LE, HIGH or LOW
t
h
Hold Time D to LE,
HIGH or LOW
5.0
(*)
5.0
10.0
12.0
12.0
ns
5.0
(*)
5.0
10.0
12.0
12.0
ns
5.0
(*)
5.5
10.0
12.0
12.0
ns
5.0
(*)
6.5
11.0
12.0
12.0
ns
5.0
(*)
1.0
3.0
4.0
4.0
ns
5.0
(*)
0.0
2.0
3.0
3.0
ns
5.0
(*)
0.0
2.0
3.0
3.0
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 74ACT573SJX | 8-Bit D-Type Latch |
| 74ACT573 | Two 1-Bit LVTTL/GTLP Adj-Edge-Rate Bus Xcvrs w Split LVTTL Port, Fdbk Path and Selectable Polarity 20-SOIC -40 to 85 |
| 74ACT573MTC | Two 1-Bit LVTTL/GTLP Adj-Edge-Rate Bus Xcvrs w Split LVTTL Port, Fdbk Path and Selectable Polarity 20-TSSOP -40 to 85 |
| 74ACT573MTCX | Two 1-Bit LVTTL/GTLP Adj-Edge-Rate Bus Xcvrs w Split LVTTL Port, Fdbk Path and Selectable Polarity 20-TSSOP -40 to 85 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| 74ACT574DWR | 制造商: 功能描述: 制造商:undefined 功能描述: |
| 74ACT574DWR2 | 制造商: 功能描述: 制造商:undefined 功能描述: |
| 74ACT574DWR2G | 制造商: 功能描述: 制造商:undefined 功能描述: |
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