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參數(shù)資料
| 型號： | 74F08 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | Quad two-input AND gate(四2輸入與門) |
| 中文描述： | 四2輸入與門（四2輸入與門） |
| 文件頁數(shù)： | 2/8頁 |
| 文件大小： | 70K |
| 代理商： | 74F08 |
Philips Semiconductors
Product specification
74F08
Quad 2-input AND gate
2
1995 Apr 19
853–0328 15145
74F08 Available for industrial range (–40
°
C to +85
°
C)
TYPE
TYPICAL
PROPAGATION
DELAY
TYPICAL
SUPPLY CURRENT
(TOTAL)
74F08
4.1ns
7.1mA
PIN CONFIGURATION
14
13
12
11
10
9
8
7
6
5
4
3
2
1
GND
V
CC
D2b
D2a
Q2
Q3
D3b
D3a
D0a
D0b
Q1
Q0
D1a
D1b
SF00038
ORDERING INFORMATION
DESCRIPTION
COMMERCIAL RANGE
V
CC
= 5.0V
±
10%, T
amb
= 0
°
C to +70
°
C
INDUSTRIAL RANGE
V
CC
= 5.0V
±
10%, T
amb
= –40
°
C to +85
°
C
PKG DWG #
14-pin plastic DIP
N74F08N
I74F08N
SOT27-1
14-pin plastic SO
N74F08D
I74F08D
SOT108-1
INPUT AND OUTPUT LOADING AND FAN-OUT TABLE
PINS
DESCRIPTION
74F (U.L.) HIGH/LOW
LOAD VALUE HIGH/LOW
Dna, Dnb
Data inputs
1.0/1.0
20
μ
A/0.6mA
Qn
Data output
50/33
1.0mA/20mA
NOTE:
One (1.0) FAST unit load is defined as: 20
μ
A in the High state and 0.6mA in the Low state.
LOGIC DIAGRAM
D0a
D0b
D1a
D1b
D2a
D2b
Q0
D3a
D3b
Q1
Q2
Q3
V
= Pin 14
GND = Pin 7
3
6
8
11
1
2
4
5
9
10
12
13
SF00052
FUNCTION TABLE
INPUTS
Dna
Dnb
Qn
L
L
L
L
H
L
H
L
L
H
H
H
NOTES:
H = High voltage level
L
= Low voltage level
LOGIC SYMBOL
D0a D0bD1a
D2a D2b D3a D3b
D1b
Q0 Q1 Q2 Q3
3
6
8
11
1
2
4
5
9
10 12 13
V
= Pin 14
GND = Pin 7
SF00040
LOGIC SYMBOL (IEEE/IEC)
1
2
4
5
9
10
12
13
&
3
6
8
11
SF00053
相關PDF資料 |
PDF描述 |
|---|---|
| 74F1071MSAX | COMMON ANODE DIODE ARRAY|SO |
| 74F1071MTCX | COMMON ANODE DIODE ARRAY|SO |
| 74F1071SCX | COMMON ANODE DIODE ARRAY|SO |
| 74F109SCX | J-K-Type Flip-Flop |
| 74F109SJX | J-K-Type Flip-Flop |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| 74F08 92 | 制造商:Motorola 功能描述:74F08 MOTOROLA S1I2C |
| 74F08_00 | 制造商:FAIRCHILD 制造商全稱:Fairchild Semiconductor 功能描述:Quad 2-Input AND Gate |
| 74F0892 | 制造商:Motorola 功能描述:74F08 MOTOROLA S1I2C |
| 74F08D | 制造商:NXP Semiconductors 功能描述:QUAD 2-INPUT AND GATE |
| 74F08DC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Quad 2-input AND Gate |
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