參數(shù)資料
型號： 79RC32V332-133DHI
英文描述： 8-pin, 1.5KB Flash Program, 64B Flash Data, 8MHz Internal Oscillator, -40C to +85C, 8-MSOP, TUBE
中文描述： 微處理器| 32位| QFP封裝| 208PIN |塑料
文件頁數(shù)： 226/654頁
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代理商： 79RC32V332-133DHI
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IDT DDR Controller
DDR Write Transaction
79RC32438 User Reference Manual
7 - 22
November 4, 2002
Notes
Figure 7.18 DDR SDRAM Write Transaction with Wrong Page Active in Bank (Bank Page Miss)
1
A DDR SDRAM write transaction in which the wrong page is active in a bank is shown in Figure 7.18. If
no pages had been active, then the transaction would have started with the ACTIVE command (i.e., step
three below). If the correct page had been active (bank page hit), then the transaction would have started
with the WRITE command (i.e., step five below). A DDR SDRAM write transaction in which the wrong page
is active consists of the following steps.
1. The RC32438 asserts the appropriate DDR SDRAM chip select (DDRCSNx), drives the bank select
pins (DDRBA[1:0]) with the value of the bank to be precharged, drives the AP address bit low (see
Tables 7.3 and 7.4) to indicate that only that bank is to be precharged, and drives the PRECHARGE
command (see Table 7.5) on the rising edge of DDRCKPx. This indicates the start of a transaction.
2. One clock cycle after step #1, the RC32438 drives the NOP command (see Table 7.5).
3. RP clock cycles after step #1, the RC32438 drives the bank select pins (DDRBA[1:0]) with the value
of the bank to be accessed, drives the address bus (DDRADDR[13:0]) with the DDR SDRAM row
address, and drives the ACTIVE command (see Table 7.5) on the rising edge of DDRCKPx. Note
that step #2 is skipped if the value of RP = 1 (see DDRC Register).
4. One clock cycle after step one, the RC32438 drives the NOP command (see Table 7.5).
5. RCD clock cycles after step #3, the RC32438 drives the address bus (DDRADDR[13:0]) with the
DDR SDRAM column address, and drives the WRITE command (see Table 7.5). At this time the
RC32438 may also assert the appropriate buffer output enables (DDROEN[3:0]) if the DBM bit in
the DDRC register is set. Note that step #4 is skipped if the value of RCD = 1 (see DDRC register).
6. One clock cycle after step #5, the RC32438 may drive the NOP or WRITE command depending on
the amount of data to be written. Figure 7.18 shows a write of four words, and thus two write
commands are issued (each write command writes a pair of data). During the last write command
issued, the RC32438 may assert the auto-precharge (AP) bit of the address bus (see Tables 7.3 and
7.4) depending on the state of the AP field in the DDRC register.
1.
The programmable parameters shown in Figure 7.18 are for illustrative purposes only and may vary.
RP = 2
RCD = 2
WR = 3
ATP = 8
Row A
Col A0
Col A2
NOP
PRECHG NOP
ACTV
NOP
WR
WR
NOP
NOP
NOP
NOP
PRECHG NOP
BNKx
BNKx
BNKx
BNKx
BNKx
FF
DM0 DM1DM2DM3
FF
D0
D1 D2
D3
DDRCKPx
DDRCKNx
DDRCSNx
DDRADDR[13:0]
DDRCMD
DDRCKE
DDRBA[1:0]
DDR
OEN[3:0]
DDRDM[7:0]
DDRDQSx
DDRDATA[Y:0]
WRITE TRANSACTION
Transaction
NEXT TRANSACTION
相關PDF資料
PDF描述
79RC32V333-100DH Microprocessor
79RC32V333-100DHI 8-Pin, 1.5KB Flash Program, 64B Flash Data, 8MHz Internal Oscillator, -40C to +85C, 8-DFN, T/R
79RC32V333-133DH 8-pin, 1.5KB Flash Program, 64B Flash Data, 8MHz Internal Oscillator, -40C to +85C, 8-SOIC 150mil, T/R
79RC32V333-133DHI Microprocessor
79RC32V333-150DH 8 PIN, 1.75KB, FLASH, 64B RAM, COMPARATOR, 8MHZ INTERNAL OSCILLATOR, -40C to +125C, 8-PDIP, TUBE
相關代理商/技術參數(shù)
參數(shù)描述
79RC32V332-133DP 制造商:Integrated Device Technology Inc 功能描述:MPU RC32300 RISC 32-Bit 133MHz 3.3V 208-Pin PQFP 制造商:Integrated Device Technology Inc 功能描述:79RC32V332-133DP - Bulk
79RC32V332-133DPI 制造商:Integrated Device Technology Inc 功能描述:MPU RC32300 RISC 32-Bit 133MHz 3.3V 208-Pin PQFP
79RC32V333-100DH 制造商:Integrated Device Technology Inc 功能描述:MPU RC32300 RISC 32-Bit 100MHz 3.3V 208-Pin PQFP
79RC32V333-100DHI 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor
79RC32V333-133DH 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor
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