參數(shù)資料
型號(hào)： 93725AF-T
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時(shí)鐘及定時(shí)
英文描述： 93725 SERIES, LOW SKEW CLOCK DRIVER, 6 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO48
封裝： 0.300 INCH, MO-118, SSOP-48
文件頁(yè)數(shù)： 5/8頁(yè)
文件大?。?/td> 94K
代理商： 93725AF-T
5
ICS93725
0606A—08/01/03
Electrical Characteristics - Input/Supply/Common Output Parameters
SEL_DDR=1 DDR Outputs VDD=2.5V, TA=0 - 85°C; (unless otherwise stated)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
100MHz, RL=0, CL = 0pF
141
mA
133MHz, RL=0, CL = 0pF
188
mA
200MHz, RL=0, CL = 0pF
271
mA
Output High Current
IOH
VDD=2.5V, VOUT=1V
-43
-18
mA
Output Low Current
IOL
VDD=2.5V, VOUT=1.2V
26
38
mA
VDD=2.5V
IOH = -12 mA
VDD=2.5V
IOH = 12 mA
Output differential-pair
VDD = 2.5V
Crossing voltage
100/133/166/ 200 Mhz
Input Capacitance
1
CIN
VI = GND or VDD
2pF
1Guaranteed by design, not 100% tested in production.
VOH
1.7
IDD2.5
Operating Supply Current
2V
Low-level output voltage
VOL
0.4
0.6
V
High-level output voltage
1.45
V
VOC
1.05
1.25
Recommended Operating Condition
SEL_DDR=1 DDR Outputs VDD=2.5V, TA=0 - 85°C; (unless otherwise stated)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
Power Supply Voltage
VDD2.5
2.3
2.5
2.7
V
Input High Voltage
VIH
SEL_DDR, PD# input
2
V
Input Low Voltage
VIL
SEL_DDR, PD# input
0.8
V
Input Voltage Level
VIN
02.5
2.7
V
1Guaranteed by design, not 100% tested in production.
相關(guān)PDF資料
PDF描述
93725AFLF-T 93725 SERIES, LOW SKEW CLOCK DRIVER, 6 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO48
93725AF 93725 SERIES, LOW SKEW CLOCK DRIVER, 6 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO48
93732AFT 93732 SERIES, PLL BASED CLOCK DRIVER, 6 TRUE OUTPUT(S), 6 INVERTED OUTPUT(S), PDSO28
93732AFLFT 93732 SERIES, PLL BASED CLOCK DRIVER, 6 TRUE OUTPUT(S), 6 INVERTED OUTPUT(S), PDSO28
93732AF 93732 SERIES, PLL BASED CLOCK DRIVER, 6 TRUE OUTPUT(S), 6 INVERTED OUTPUT(S), PDSO28
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參數(shù)描述
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937269-000 制造商:TE Connectivity 功能描述:PTD-75-L-03
937269-2 制造商:TE Connectivity 功能描述:MINI APPL - Bulk
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937270A 制造商:Honeywell / Clarostat 功能描述:3450RC 04780011
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