Figure 2-6 Input Buffer Delays PAD Y INBUF In 3 V 0" />
參數(shù)資料
型號(hào)： A54SX32A-2FG144
廠商： Microsemi SoC
文件頁數(shù)： 39/108頁
文件大?。?/td> 0K
描述： IC FPGA SX 48K GATES 144-FBGA
標(biāo)準(zhǔn)包裝： 160
系列： SX-A
LAB/CLB數(shù)： 2880
輸入/輸出數(shù)： 111
門數(shù)： 48000
電源電壓： 2.25 V ~ 5.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 144-LBGA
供應(yīng)商設(shè)備封裝： 144-FPBGA（13x13）
SX-A Family FPGAs
2- 16
v5.3
Input Buffer Delays
C-Cell Delays
Cell Timing Characteristics
Figure 2-6 Input Buffer Delays
PAD
Y
INBUF
In
3 V
0 V
1.5 V
Out
GND
50%
1.5 V
50%
VCC
t
INY
t
INY
Figure 2-7 C-Cell Delays
S
A
B
Y
S, A, or B
Out
GND
50%
Out
GND
50%
V
CC
V
CC
V
CC
t
PD
t
PD
t
PD
t
PD
Figure 2-8 Flip-Flops
(Positive Edge Triggered)
D
CLK
CLR
Q
D
CLK
Q
CLR
t
HPWH
t
WASYN
t
HD
t
SUD
t
HP
t
HPWL
t
RCO
t
CLR
t
RPWL
t
RPWH
PRESET
tPRESET
PRESET
相關(guān)PDF資料
PDF描述
HMC35DRAS CONN EDGECARD 70POS R/A .100 SLD
A54SX32A-2FGG144 IC FPGA SX 48K GATES 144-FBGA
A54SX32A-1FGG144I IC FPGA SX 48K GATES 144-FBGA
952-015-030R121 BACKSHELL 15POS STRGHT DIECAST
981-025-130R121 BACKSHELL 25POS R/A DIE CAST
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參數(shù)描述
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