參數(shù)資料
型號(hào): AC162078
廠商: Microchip Technology
文件頁(yè)數(shù): 51/318頁(yè)
文件大?。?/td> 0K
描述: HEADER INTRFC MPLAB ICD2 18F1330
標(biāo)準(zhǔn)包裝: 1
附件類型: 轉(zhuǎn)換接頭
適用于相關(guān)產(chǎn)品: ICD2
產(chǎn)品目錄頁(yè)面: 658 (CN2011-ZH PDF)
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PIC18F1230/1330
DS39758D-page 144
2009 Microchip Technology Inc.
14.13 PWM Update Lockout
For a complex PWM application, the user may need to
write up to four Duty Cycle registers and the PWM Time
Base Period Register, PTPER, at a given time. In some
applications, it is important that all buffer registers be
written before the new duty cycle and period values are
loaded for use by the module.
A PWM update lockout feature may optionally be
enabled so the user may specify when new duty cycle
buffer values are valid. The PWM update lockout
feature is enabled by setting the control bit, UDIS, in
the PWMCON1 register. This bit affects all Duty Cycle
Buffer registers and the PWM Time Base Period
register, PTPER.
To perform a PWM update lockout:
1.
Set the UDIS bit.
2.
Write all Duty Cycle registers and PTPER, if
applicable.
3.
Clear the UDIS bit to re-enable updates.
4.
With this, when UDIS bit is cleared, the buffer
values will be loaded to the actual registers. This
makes a synchronous loading of the registers.
14.14 PWM Special Event Trigger
The PWM module has a Special Event Trigger
capability that allows A/D conversions to be
synchronized to the PWM time base. The A/D sampling
and conversion time may be programmed to occur at
any point within the PWM period. The Special Event
Trigger allows the user to minimize the delay between
the time when A/D conversion results are acquired and
the time when the duty cycle value is updated.
The PWM 16-bit Special Event Trigger register,
SEVTCMP (high and low), and five control bits in the
PWMCON1 register are used to control its operation.
The PTMR value for which a Special Event Trigger
should occur is loaded into the SEVTCMP register pair.
SEVTDIR bit in PWMCON1 register specifies the
counting phase when the PWM time base is in a
Continuous Up/Down Count mode.
If the SEVTDIR bit is cleared, the Special Event Trigger
will occur on the upward counting cycle of the PWM
time base. If SEVTDIR is set, the Special Event Trigger
will occur on the downward count cycle of the PWM
time base. The SEVTDIR bit only effects this operation
when the PWM timer is in the Continuous Up/Down
Count mode.
14.14.1
SPECIAL EVENT TRIGGER ENABLE
The PWM module will always produce Special Event
Trigger pulses. This signal may optionally be used by
the A/D module. Refer to Chapter 16.0 "10-Bit
for
details.
14.14.2
SPECIAL EVENT TRIGGER
POSTSCALER
The PWM Special Event Trigger has a postscaler that
allows a 1:1 to 1:16 postscale ratio. The postscaler is
configured by writing the SEVOPS3:SEVOPS0 control
bits in the PWMCON1 register.
The Special Event Trigger output postscaler is cleared
on any write to the SEVTCMP register pair, or on any
device Reset.
Note:
The Special Event Trigger will take place
only for non-zero values in the SEVTCMP
registers.
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PDF描述
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參數(shù)描述
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AC162083 功能描述:插座和適配器 MPLAB ICD 2 8L/14L HEADER PIC16F616 RoHS:否 制造商:Silicon Labs 產(chǎn)品:Adapter 用于:EM35x
AC162087 功能描述:插座和適配器 MPLAB ICD 2 68/84 HEADER (PIC18F87J50) RoHS:否 制造商:Silicon Labs 產(chǎn)品:Adapter 用于:EM35x
AC162088 功能描述:插座和適配器 MPLAB ICD 2 PIC24FJ64GA004 28P RoHS:否 制造商:Silicon Labs 產(chǎn)品:Adapter 用于:EM35x
AC162088 制造商:Microchip Technology Inc 功能描述:MPLAB ICD 2 PIC24FJ64GA004 28P Header