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參數(shù)資料
| 型號： | AD1836ACSZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 9/24頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CODEC 4ADC/6DAC 24 BIT 52MQFP |
| 標準包裝： | 1 |
| 類型： | 通用 |
| 數(shù)據(jù)接口： | 串行 |
| 分辨率（位）： | 24 b |
| ADC / DAC 數(shù)量： | 4 / 6 |
| 三角積分調(diào)變： | 是 |
| S/N 比，標準 ADC / DAC (db)： | 105 / 108 |
| 動態(tài)范圍，標準 ADC / DAC (db)： | 105 / 108 |
| 電壓 - 電源，模擬： | 4.75 V ~ 5.25 V |
| 電壓 - 電源，數(shù)字： | 4.75 V ~ 5.25 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 52-QFP |
| 供應商設備封裝： | 52-MQFP（10x10） |
| 包裝： | 托盤 |
| 配用： | AD1836AZ-DBRD-ND - BOARD EVAL FOR AD1836A |
Data Sheet
AD1836A
Rev. A | Page 17 of 24
30MHz
12.288MHz
SHARC IS ALWAYS
RUNNING IN SLAVE MODE
(INTERRUPT-DRIVEN)
F
S
YNC-TDM
(RF
S
)
RxCLK
RxDATA
TF
S
(NC)
TxCLK
TxDATA
ASDATA1 ALRCLK ABCLK DSDATA1
LRCLK
BCLK
DATA
MCLK
ADC NO. 1
SLAVE
SHARC
AD1836A
MASTER
MCLK
DSDATA3/AAUXDATA2
DSDATA2/AAUXDATA1
DLRCLK/AUXLRCLK
ASDATA2/DAUXDATA
DBCLK/AUXBCLK (64fS)
LRCLK
BCLK
ADC NO. 2
SLAVE
LRCLK
BCLK
DATA
MCLK
DAC
DATA
MCLK
Figure 10. AUX Mode Connection to SHARC (Master Mode)
30MHz
12.288MHz
SHARC IS ALWAYS
RUNNING IN SLAVE MODE
(INTERRUPT-DRIVEN)
F
S
YNC-TDM
(RF
S
)
RxCLK
RxDATA
TF
S
(NC)
TxCLK
TxDATA
ASDATA1 ALRCLK ABCLK DSDATA1
LRCLK
BCLK
DATA
MCLK
ADC NO. 1
MASTER
SHARC
AD1836A
SLAVE
MCLK
DSDATA3/AAUXDATA2
DSDATA2/AAUXDATA1
DLRCLK/AUXLRCLK
ASDATA2/DAUXDATA
DBCLK/AUXBCLK (64fS)
LRCLK
BCLK
LRCLK
BCLK
DATA
MCLK
DAC
ADC NO. 2
SLAVE
DATA
MCLK
Figure 11. AUX Mode Connection to SHARC (Slave Mode)
相關PDF資料 |
PDF描述 |
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