Type 1 Mnemonic Description 23 I VSUPPLY 5 V Input to Regulator, " />
參數(shù)資料
型號： AD1937WBSTZ-RL
廠商： Analog Devices Inc
文件頁數(shù)： 4/36頁
文件大?。?/td> 0K
描述： IC CODEC 4/ADC DIFF OUT 64-LQFP
標(biāo)準(zhǔn)包裝： 1,500
類型： 通用
數(shù)據(jù)接口： 串行
分辨率（位）： 24 b
ADC / DAC 數(shù)量： 4 / 8
三角積分調(diào)變： 是
S/N 比，標(biāo)準(zhǔn) ADC / DAC (db)： 96 / 96
動態(tài)范圍，標(biāo)準(zhǔn) ADC / DAC (db)： 105 / 110
電壓 - 電源，模擬： 3 V ~ 3.6 V
電壓 - 電源，數(shù)字： 3 V ~ 3.6 V
工作溫度： -40°C ~ 125°C
安裝類型： 表面貼裝
封裝/外殼： 64-LQFP
供應(yīng)商設(shè)備封裝： 64-LQFP（10x10）
包裝： 帶卷 (TR)
AD1937
Rev. B | Page 12 of 36
Pin No.
Type 1
Mnemonic
Description
23
I
VSUPPLY
5 V Input to Regulator, Emitter of Pass Transistor.
24
I
VSENSE
Connect 3.3 V Regulator Output, Collector of Pass Transistor, to This Pin.
25
O
VDRIVE
Drive for Base of Pass Transistor.
26
I/O
ASDATA2
ADC Serial Data Output 2. Data Output from ADC2/TDM ADC data in/AUX DAC1 data out (to
external DAC1).
27
O
ASDATA1
ADC Serial Data Output 1. Data Output from ADC1/TDM ADC data out/TDM data out.
28
I/O
ABCLK
Bit Clock for ADCs. Can be programmed as input or output in all modes.
29
I/O
ALRCLK
Frame Clock for ADCs. Can be programmed as input or output in all modes.
30
I
ADDR0
I2C Address Assignment.
31
I/O
SDA
Control Data Port (I2C).
34
I
SCL
Control Clock Port (I2C).
35
I
ADDR1
I2C Address Assignment.
36
O
DAC1LP
DAC1 Left Positive Output.
37
O
DAC1LN
DAC1 Left Negative Output.
38
O
DAC1RP
DAC1 Right Positive Output.
39
O
DAC1RN
DAC1 Right Negative Output.
40
O
DAC2LP
DAC2 Left Positive Output.
41
O
DAC2LN
DAC2 Left Negative Output.
42
O
DAC2RP
DAC2 Right Positive Output.
43
O
DAC2RN
DAC2 Right Negative Output.
47
O
FILTR
Analog Voltage Reference Filter Capacitor Connection. Bypass with 10 μF||100 nF to AGND.
49, 50, 63, 64
NC
No Connect.
52
O
CM
Common-Mode Reference Filter Capacitor Connection. Bypass with 47 μF||100 nF to AGND.
53
I
ADC1LP
ADC1 Left Positive Input.
54
I
ADC1LN
ADC1 Left Negative Input.
55
I
ADC1RP
ADC1 Right Positive Input.
56
I
ADC1RN
ADC1 Right Negative Input.
57
I
ADC2LP
ADC2 Left Positive Input.
58
I
ADC2LN
ADC2 Left Negative Input.
59
I
ADC2RP
ADC2 Right Positive Input.
60
I
ADC2RN
ADC2 Right Negative Input.
61
O
LF
PLL Loop Filter, Return to AVDD.
1 I = input, O = output.
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PDF描述
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